參數(shù)資料
型號： MPC509
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁數(shù)： 175/300頁
文件大小： 3744K
代理商： MPC509
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MPC509
USER’S MANUAL
SYSTEM INTERFACE UNIT
Rev. 15 June 98
MOTOROLA
5-81
The state of the decrementer and time base after standby power is restored is indeter-
minate. The decrementer runs continuously after power-up (unless the decrementer
clock enable bit is cleared). System software is necessary to perform any initialization.
The decrementer is not affected by reset and continues counting while reset is
asserted.
Reads and writes of the time base and decrementer are restricted to special instruc-
tions. Refer to
SECTION 3 CENTRAL PROCESSING UNIT
and to the RCPU
Reference Manual (RCPURM/AD) for instructions on reading and writing the time
base and decrementer.
5.6.9.1 Time Base and Decrementer Clock Source
The frequency source is the crystal oscillator divided by four
The clock source for the time base and decrementer is the crystal oscillator divided by
four. With a 4-MHz oscillator frequency, the period for the time base is:
T
TB
= 2
64
/ 1MHz = 1.8 x 10
13
seconds
which is approximately 585,000 years.
With the same clock source, the period for the decrementer is:
T
DEC
= 2
32
/ 1MHz = 4295 seconds
which is approximately 71.6 minutes.
5.6.9.2 Time Base/Decrementer and Freeze Assertion
The assertion of the global freeze signal can stop the clock to the time base and dec-
rementer if the SIUFRZ bit in the SIUMCR (0x8007 FC00) is set. The actual freezing
of the clock source occurs at the falling edge of the clock.
5.6.9.3 Decrementer Clock Enable (DCE) Bit
The decrementer clock enable (DCE) bit in the SCCR enables or disables the clock
source to the decrementer. The default state is to have the clock enabled. The actual
clock source is determined by the TBS bit. The DCE bit does not affect the decre-
menter until after the next increment time, as determined by the clock source.
5.6.10 Clock Resets
The following reset conditions cause the internal clock reset signal to be asserted:
external reset, loss-of-oscillator (when LOORE is set), and loss-of-lock (when LOLRE
is set). Clock reset causes the clock circuitry, including the PLL, oscillator, SCCR, and
SCLSR to be reset.
Note that all reset sources cause normal reset processing to occur, as described in
5.8
Reset Operation
. However, only the reset sources mentioned above (external reset,
loss-of-oscillator, and loss-of-lock) result in clock reset.
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