參數資料
型號: MPC509
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述: 32-BIT, RISC MICROCONTROLLER, PQFP16
文件頁數: 125/300頁
文件大?。?/td> 3744K
代理商: MPC509
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁當前第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁
MPC509
USER’S MANUAL
SYSTEM INTERFACE UNIT
Rev. 15 June 98
MOTOROLA
5-31
The I-bus show cycles are always address-only cycles. They do not wait for the inter-
nal transaction to complete. L-bus show cycles have both address and data and
appear on the external bus after the internal cycle is completed.
Aborted L-bus cycles do not result in a show cycle. (The load/store unit of the proces-
sor may abort the cycle when the previous cycle terminates with a transfer error, or
when an exception occurs during the current cycle.)
Aborted I-bus cycles do result in a show cycle. (The processor may abort an I-bus
cycle when it encounters a branch; it aborts the fetch just starting on a wrong path. In
addition, the processor aborts the cycle on a cache hit.)
Note that I-bus show cycles are not burst.
A show cycle involves transfer start (TS), address (ADDR), cycle type (CT), address
type (AT), burst (BURST) and read/write (WR) pins. The data phase of an L-bus show
cycle looks like a write cycle going out on the external bus. The address and data
phases of a show cycle last one clock cycle each. No termination is needed for either
phase, as all show cycles are automatically terminated inside the SIU. For the L-bus
show cycles (I-bus show cycles are address only), the data phase always follows the
address phase by one clock cycle. The L-bus show cycle does not start until the inter-
nal cycle completes. This allows all show cycles to complete in two clock cycles.
Show cycles require several holding registers in the SIU to hold address and data of
an L-bus cycle and address of an I-bus cycle until the E-bus is available and the show
cycle is run. When these holding registers are full, the internal bus (or buses) are held
up by the SIU while it waits for the show cycle to complete.
During cross-bus accesses, the show cycle is associated with the bus initiating the
transaction. For example, if I-bus show cycles are enabled and L-bus show cycles are
disabled, then an instruction fetch from L-RAM will show up as an address-only I-bus
show cycle, and an L-bus access to I-memory would not have a show cycle.
Refer to
SECTION 8 DEVELOPMENT SUPPORT
for more information on show
cycles.
5.4.14 Storage Reservation Support
The PowerPC
lwarx
(load word and reserve indexed) and
stwcx.
(store word condi-
tional indexed) instructions in combination permit the atomic update of a storage
location. Refer to the RCPU Reference Manual(RCPURM/AD) for details on these
instructions.
The storage reservation protocol supports a multi-level bus structure like the one
shown in
Figure 5-10
. In this figure, the E-bus is a PowerPC bus interfaced to a non-
local bus, such as a PC/AT or VME bus, through a non-local bus interface. For each
local bus, storage reservation is handled by the local reservation logic.
The protocol tries to optimize reservation cancellation such that a PowerPC processor
is notified of the loss of a storage reservation on a remote bus only when it has issued
相關PDF資料
PDF描述
MPC5200BV400 MPC5200 Hardware Specifications
MPC5200CBV266 MPC5200 Hardware Specifications
MPC5200CBV400 MPC5200 Hardware Specifications
MPC5200ID MPC5200 Hardware Specifications
MPC555 Highly Integrated, Low-Power, 32-Bit Microcontroller
相關代理商/技術參數
參數描述
MPC509A 制造商:BB 制造商全稱:BB 功能描述:Single-Ended 8-Channel/Differential 4-Channel CMOS ANALOG MULTIPLEXERS
MPC509AP 功能描述:多路器開關 IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數量:1 開關數量:4 開啟電阻(最大值):7 Ohms 開啟時間(最大值): 關閉時間(最大值): 傳播延遲時間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UQFN-16
MPC509AP 制造商:BURR-BROWN 功能描述:IC MUX 4CH DP DIP28 509 制造商:Texas Instruments 功能描述:Multiplexer IC Multiplexer Type:Differen
MPC509APG4 功能描述:多路器開關 IC 4Ch Diff-Input Ana Multiplexer RoHS:否 制造商:Texas Instruments 通道數量:1 開關數量:4 開啟電阻(最大值):7 Ohms 開啟時間(最大值): 關閉時間(最大值): 傳播延遲時間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UQFN-16
MPC509AU 功能描述:多路器開關 IC 4-Ch Diff-Input Analog Mult RoHS:否 制造商:Texas Instruments 通道數量:1 開關數量:4 開啟電阻(最大值):7 Ohms 開啟時間(最大值): 關閉時間(最大值): 傳播延遲時間:0.25 ns 工作電源電壓:2.3 V to 3.6 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:UQFN-16