參數(shù)資料
型號: MII-300GP
元件分類: 微控制器/微處理器
英文描述: 32-BIT, 300 MHz, MICROPROCESSOR, PGA296
封裝: SPGA, 296 PIN
文件頁數(shù): 215/257頁
文件大小: 1234K
代理商: MII-300GP
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2-29
2
PRELIMINARY
System Register Set
7
654
3
2
1
0
MAPEN3
MAPEN2
MAPEN1
MAPEN0
Reserved
LINBRST
NMI_EN
SMI_LOCK
Figure 2-16. M II Configuration Control Register 3 (CCR3)
Table 2-15. CCR3 Bit Definitions
BIT
POSITION
NAME
DESCRIPTION
7 - 4
MAPEN(3-0)
MAP Enable
If = 1h: All configuration registers are accessible.
If = 0h: Only configuration registers with indexes C0-CFh, FEh and FFh
are accessible.
2
LINBRST
If = 1: Use linear address sequence during burst cycles.
If = 0: Use “1 + 4” address sequence during burst cycles. The “1 + 4” address
sequence is compatible with Pentium’s burst address sequence.
1
NMI_EN
NMI Enable
If = 1: NMI interrupt is recognized while servicing an SMI interrupt.
NMI_EN should be set only while in SMM, after the appropriate SMI interrupt
service routine has been setup.
0
SMI_LOCK
SMI Lock
If = 1: The following SMM configuration bits can only be modified while in an
SMI service routine:
CCR1: USE_SMI, SMAC, SM3
CCR3: NMI_EN
CCR6: N, SMM_MODE
ARR3: Starting address and block size.
Once set, the features locked by SMI_LOCK cannot be unlocked until the
RESET pin is asserted.
Note: Bit 3 is reserved.
相關(guān)PDF資料
PDF描述
MJ10000 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ1000 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ1001 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ10022 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE
MJ3000 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA
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參數(shù)描述
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