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參數(shù)資料
| 型號： | MII-300GP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PGA296 |
| 封裝： | SPGA, 296 PIN |
| 文件頁數(shù)： | 113/257頁 |
| 文件大?。?/td> | 1234K |
| 代理商： | MII-300GP |
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1-5
Integer Unit
1
PRELIMINARY
1.2.3 Pipeline Selection
In most cases, instructions are processed in
either pipeline and without pairing constraints
on the instructions. However, certain instruc-
tions are processed only in the X pipeline:
Branch instructions
Floating point instructions
Exclusive instructions
Branch and floating point instructions may be
paired with a second instruction in the Y pipe-
line.
Exclusive Instructions cannot be paired with
instructions in the Y pipeline. These instruc-
tions typically require multiple memory
accesses. Although exclusive instructions may
not be paired, hardware from both pipelines is
used to accelerate instruction completion.
Listed below are the M II CPU exclusive
instruction types:
Protected mode segment loads
Special register accesses
(Control, Debug, and Test Registers)
String instructions
Multiply and divide
I/O port accesses
Push all (PUSHA) and pop all (POPA)
Intersegment jumps, calls, and returns
1.2.4 Data Dependency
Solutions
When two instructions that are executing in
parallel require access to the same data or
register, one of the following types of data
dependencies may occur:
Read-After-Write (RAW)
Write-After-Read (WAR)
Write-After-Write (WAW)
Data dependencies typically force serialized
execution of instructions. However, the M II
CPU implements three mechanisms that allow
parallel execution of instructions containing
data dependencies:
Register Renaming
Data Forwarding
Data Bypassing
The following sections provide detailed exam-
ples of these mechanisms.
1.2.4.1
Register Renaming
The M II CPU contains 32 physical general
purpose registers. Each of the 32 registers in
the register file can be temporarily assigned as
one of the general purpose registers defined by
the x86 architecture (EAX, EBX, ECX, EDX,
ESI, EDI, EBP, and ESP). For each register
write operation a new physical register is
selected to allow previous data to be retained
temporarily. Register renaming effectively
removes all WAW and WAR dependencies.
The programmer does not have to consider
register renaming as register renaming is
completely transparent to both the operating
system and application software.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MJ10000 | 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1001 | 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ10022 | 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE |
| MJ3000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MII400-12E4 | 功能描述:分立半導(dǎo)體模塊 IGBT MODULE 1200V, 400A RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝: |
| MII-400GP 95MHZ2.2V | 制造商:CYRIX 功能描述: |
| MII75-12A3 | 功能描述:分立半導(dǎo)體模塊 75 Amps 1200V RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝: |
| MI-IAM | 制造商:VICOR 制造商全稱:Vicor Corporation 功能描述:Military Input Attenuator Modules |
| MIIC5271 | 制造商:MICREL 制造商全稱:Micrel Semiconductor 功能描述:UCAP NEGATIVE LOW DROPOUT REGULATOR |
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