- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄370430 > HB52RD328DC (Hitachi,Ltd.) 256 MB Unbuffered SDRAM S.O.DIMM(256 MB 未緩沖同步DRAM S.O.DIMM) PDF資料下載
參數(shù)資料
| 型號： | HB52RD328DC |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | 256 MB Unbuffered SDRAM S.O.DIMM(256 MB 未緩沖同步DRAM S.O.DIMM) |
| 中文描述： | 256 MB的無緩沖內(nèi)存的SODIMM（256 MB的未緩沖同步內(nèi)存的SODIMM） |
| 文件頁數(shù)： | 27/68頁 |
| 文件大小： | 885K |
| 代理商： | HB52RD328DC |
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HB52RD328DC-F
27
Function Truth Table
The following table shows the operations that are performed when each command is issued in each mode of
the SDRAM module. The following table assumes that CKE is high.
Current state
S
RE
CE
W
Address
Command
Operation
Precharge
H
×
×
×
×
×
×
DESL
Enter IDLE after t
RP
Enter IDLE after t
RP
NOP
L
H
H
H
NOP
L
H
H
L
BST
L
H
L
H
BA, CA, A10 READ/READ A
ILLEGAL*
4
L
H
L
L
BA, CA, A10 WRIT/WRIT A
ILLEGAL*
4
L
L
H
H
BA, RA
ACTV
ILLEGAL*
4
L
L
H
L
BA, A10
PRE, PALL
NOP*
6
L
L
L
H
×
REF, SELF
ILLEGAL
L
L
L
L
MODE
MRS
ILLEGAL
Idle
H
×
×
×
×
×
×
DESL
NOP
L
H
H
H
NOP
NOP
L
H
H
L
BST
NOP
L
H
L
H
BA, CA, A10 READ/READ A
ILLEGAL*
5
L
H
L
L
BA, CA, A10 WRIT/WRIT A
ILLEGAL*
5
L
L
H
H
BA, RA
ACTV
Bank and row active
L
L
H
L
BA, A10
PRE, PALL
NOP
L
L
L
H
×
REF, SELF
Refresh
L
L
L
L
MODE
MRS
Mode register set
Row active
H
×
×
×
×
×
×
DESL
NOP
L
H
H
H
NOP
NOP
L
H
H
L
BST
NOP
L
H
L
H
BA, CA, A10 READ/READ A
Begin read
L
H
L
L
BA, CA, A10 WRIT/WRIT A
Begin write
L
L
H
H
BA, RA
ACTV
Other bank active
ILLEGAL on same bank*
3
L
L
H
L
BA, A10
PRE, PALL
Precharge
L
L
L
H
×
REF, SELF
ILLEGAL
L
L
L
L
MODE
MRS
ILLEGAL
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HB52RF1289E2-75B | x72 SDRAM Module |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| HB52RD328DC-B6F | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x64 SDRAM Module |
| HB52RD328DC-B6FL | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:x64 SDRAM Module |
| HB52RD328DC-F | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256 MB Unbuffered SDRAM S.O.DIMM 32-Mword × 64-bit, 100 MHz Memory Bus, 2-Bank Module (32 pcs of 16 M × 4 components) PC100 SDRAM |
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