參數(shù)資料
型號(hào)： GM5060-H
廠商： Electronic Theatre Controls, Inc.
英文描述： GRAPHICS PROCESSING IC PROVIDING HIGH QUALITY IMAGES FOR LCD MONITORS
中文描述： 圖形處理芯片提供高品質(zhì)的圖像液晶顯示器
文件頁數(shù)： 83/85頁
文件大小： 1375K
代理商： GM5060-H
Genesis Microchip
gm5060 / gm5060-H Data Sheet
February 2002
C5060-DAT-01G
75
Table 22. Display Timing and DCLK Adjustments
DP_TIMING ->
Tap 0
(default)
Min
(ns)
1.0
1.0
0.5
1.0
0.5
Tap 1
Tap 2
Tap 3
Max
(ns)
4.5
4.5
4.5
4.5
4.5
Min
(ns)
0.5
0.5
0.0
0.5
0.0
Max
(ns)
3.5
3.5
3.5
3.5
3.5
Min
(ns)
-0.5
-0.5
-1.0
-0.5
-1.0
Max
(ns)
2.5
2.5
2.5
2.5
2.5
Min
(ns)
-1.5
-1.5
-2.0
-1.5
-2.0
Max
(ns)
1.5
1.5
1.5
1.5
1.5
Propagation delay from DCLK to DA*/DB*
Propagation delay from DCLK to DHS
Propagation delay from DCLK to DVS
Propagation delay from DCLK to DEN
Propagation delay from DCLK to DOVL
Note: DCLK Clock Adjustments are the amount of additional delay that can be inserted in the DCLK path, in order to reduce
the propagation delay between DCLK and its related signals.
Table 23. 2-Wire Host I/F Port Timing
Parameter
Symbol
MIN
TYP
MAX
Units
SCL HIGH time
SCL LOW time
SDA to SCL Setup
SDA from SCL Hold
Propagation delay from SCL to SDA
T
SHI
T
SLO
T
SDIS
T
SDIH
T
SDO3
1.25
1.25
30
20
10
us
us
ns
ns
ns
150
The above table assumes OCM_CLK = R_CLK / 2 = 100 MHz (default) (ie 10ns / clock)
Table 24. 6-Wire Host I/F Port Timing
Parameter
Symbol
MIN
TYP
MAX
Units
HCLK HIGH time
HCLK LOW time
HFSn to HCLK Setup
HFSn from HCLK Hold
HDATA to HCLK Setup
HDATA from HCLK Hold
Propagation delay from HCLK to
HDATA
The above table assumes OCM_CLK = R_CLK / 2 = 100 MHz (default)
T
SHI
T
SLO
T
SDIS
T
SDIH
T
SDO3
100
100
30
20
30
20
10
-
-
-
-
-
-
-
-
-
-
-
-
-
ns
ns
ns
ns
ns
ns
ns
100
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PDF描述
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