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參數(shù)資料
| 型號： | UPD78F0394GC-8EA-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 503/682頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT 48KB FLASH |
| 標準包裝： | 400 |
| 系列： | 78K0/Lx2 |
| 核心處理器： | 78K/0 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 48KB（48K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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CHAPTER 22 STANDBY FUNCTION
User’s Manual U17473EJ2V0UD
549
Cautions 1. To use the peripheral hardware that stops operation in the STOP mode, and the peripheral
hardware for which the clock that stops oscillating in the STOP mode after the STOP mode is
released, restart the peripheral hardware.
2. Even if “internal low-speed oscillator can be stopped by software” is selected by the option
byte, the internal low-speed oscillation clock continues in the STOP mode in the status before
the STOP mode is set. To stop the internal low-speed oscillator’s oscillation in the STOP mode,
stop it by software and then execute the STOP instruction.
3. To shorten oscillation stabilization time after the STOP mode is released when the CPU operates
with the high-speed system clock (X1 oscillation), temporarily switch the CPU clock to the
internal high-speed oscillation clock before the next execution of the STOP instruction. Before
changing the CPU clock from the internal high-speed oscillation clock to the high-speed system
clock (X1 oscillation) after the STOP mode is released, check the oscillation stabilization time
with the oscillation stabilization time counter status register (OSTC).
4. If the STOP instruction is executed when AMPH = 1, supply of the CPU clock is stopped for 4.06
to 16.12
μs after the STOP mode is released when the internal high-speed oscillation clock is
selected as the CPU clock, or for the duration of 160 external clocks when the high-speed
system clock (external clock input) is selected as the CPU clock.
(2) STOP mode release
Figure 22-5. Operation Timing When STOP Mode Is Released
STOP mode
STOP mode release
High-speed system
clock (X1 oscillation)
High-speed system
clock (external clock
input)
Internal high-speed
oscillation clock
High-speed system
clock (X1 oscillation)
is selected as CPU
clock when STOP
instruction is executed
High-speed system
clock (external clock
input) is selected as
CPU clock when STOP
instruction is executed
Internal high-speed
oscillation clock is
selected as CPU clock
when STOP instruction
is executed
Wait for oscillation accuracy
stabilization (86 to 361 s)
μ
HALT status
(oscillation stabilization time set by OSTS)
Clock switched by software
High-speed system clock
WaitNote2
Supply of the CPU clock is stopped (4.06 to 16.12 s)Note1
High-speed system clock
μ
Supply of the CPU clock is stopped (160 external clocks)Note1
Internal high-speed
oscillation clock
Notes 1. When AMPH = 1
2. The wait time is as follows:
When vectored interrupt servicing is carried out:
8 or 9 clocks
When vectored interrupt servicing is not carried out:
2 or 3 clocks
<R>
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
| UPD78F0395GC(R)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0395GC(T)-8EA | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0395GC(T)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0397DGC(T)-8EA | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0397DGC(T)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
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