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參數(shù)資料
| 型號： | UPD78F0394GC-8EA-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 371/682頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8BIT 48KB FLASH |
| 標(biāo)準(zhǔn)包裝： | 400 |
| 系列： | 78K0/Lx2 |
| 核心處理器： | 78K/0 |
| 芯體尺寸： | 8-位 |
| 速度： | 20MHz |
| 連通性： | 3 線 SIO，I²C，LIN，UART/USART |
| 外圍設(shè)備： | LCD，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 40 |
| 程序存儲器容量： | 48KB（48K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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CHAPTER 17 SERIAL INTERFACE IIC0
User’s Manual U17473EJ2V0UD
430
(5) Setting STT0 and SPT0 (bits 1 and 0 of IICC0) again after they are set and before they are cleared to 0 is
prohibited.
(6) When transmission is reserved, set SPIE0 (bit 4 of IICL0) to 1 so that an interrupt request is generated when
the stop condition is detected. Transfer is started when communication data is written to IIC0 after the interrupt
request is generated. Unless the interrupt is generated when the stop condition is detected, the device stops
in the wait state because the interrupt request is not generated when communication is started. However, it is
not necessary to set SPIE0 to 1 when MSTS0 (bit 7 of IICS0) is detected by software.
17.5.16 Communication operations
The following shows three operation procedures with the flowchart.
(1) Master operation in single master system
The flowchart when using the 78K0/LG2 as the master in a single master system is shown below.
This flowchart is broadly divided into the initial settings and communication processing. Execute the initial
settings at startup. If communication with the slave is required, prepare the communication and then execute
communication processing.
(2) Master operation in multimaster system
In the I
2C bus multimaster system, whether the bus is released or used cannot be judged by the I2C bus
specifications when the bus takes part in a communication. Here, when data and clock are at a high level for a
certain period (1 frame), the 78K0/LG2 takes part in a communication with bus released state.
This flowchart is broadly divided into the initial settings, communication waiting, and communication processing.
The processing when the 78K0/LG2 looses in arbitration and is specified as the slave is omitted here, and only
the processing as the master is shown. Execute the initial settings at startup to take part in a communication.
Then, wait for the communication request as the master or wait for the specification as the slave. The actual
communication is performed in the communication processing, and it supports the transmission/reception with
the slave and the arbitration with other masters.
(3) Slave operation
An example of when the 78K0/LG2 is used as the I
2C bus slave is shown below.
When used as the slave, operation is started by an interrupt. Execute the initial settings at startup, then wait
for the INTIIC0 interrupt occurrence (communication waiting).
When an INTIIC0 interrupt occurs, the
communication status is judged and its result is passed as a flag over to the main processing.
By checking the flags, necessary communication processing is performed.
<R>
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD78F1146AF1-AN1-A | MCU 16BIT 78K0R/KX3 64-FBGA |
| UPD78F1156AGC-GAD-AX | MCU 16BIT 78K0R/KX3 80-LQFP |
| UPD78F1168AGF-GAS-AX | MCU 16BIT 78K0R/KX3 100-LQFP |
| UPD78F1178AGF-GAT-AX | MCU 16BIT 78K0R/KX3 128-LQFP |
| UPD78F1188AGJ-GAE-AX | MCU 16BIT 78K0R/KX3 144-LQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD78F0395GC(R)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0395GC(T)-8EA | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0395GC(T)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0397DGC(T)-8EA | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD78F0397DGC(T)-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
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