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參數(shù)資料
| 型號： | SPAK302FC25C |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP132 |
| 封裝： | 0.950 X 0.950 INCH, 0.025 INCH PITCH, PLASTIC, QFP-132 |
| 文件頁數(shù)： | 56/128頁 |
| 文件大?。?/td> | 641K |
| 代理商： | SPAK302FC25C |
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MC68EN302 DRAM Control Module
3-2
MC68EN302 REFERENCE MANUAL
MOTOROLA
PE1-PE0—Enable Parity.
0 = Parity is generated but not checked
1 = Parity is generated on writes, and parity is checked on reads in the corresponding
bank. If a parity error is detected the bus cycle is terminated with a bus error.
NOTE
If the Parity Pin Enable bit (PPE in MBC CSR) = 0 and parity is
enabled on the DRAM interface (PE1 and/or PE0 = 1 in DCR)
then a parity error will be reported on PED1–PED0.
P1-P0—RAS Precharge bits. These bits control the minimum number of clocks the RAS
signal is precharged between bus cycles. Table 3-3 shows the encoding for these bits.
W1-W0—Wait state bits. These bits control the number of wait states required for DRAM
bank accesses. Table 3-3 shows the wait state bit encodings.
WP1-WP0—Write Protect. This bit enables and disables write protection to a corresponding
DRAM bank.
0 = The corresponding DRAM bank may be written.
1 = Write access to the corresponding DRAM bank returns a bus error.
S/U1-S/U0—Supervisor/User. This bit determines whether the given DRAM bank decodes
to Supervisor Space (FC = 6 & 5) or both Supervisor and User (FC = 6 & 5 & 1 & 2) Space.
0 = Respond to Supervisor accesses only
1 = Respond to Supervisor and User Space.
3.4 DRAM REFRESH REGISTER (DRFRSH)
This register controls the operation of the refresh circuitry and is initialized to zero on
hardware reset.
Table 3-2. Precharge Bit Encodings
P1
P0
PRECHARGE CLOCKS
00
2
01
3
10
4
11
5
Table 3-3. Wait State Bit Encodings
W1
W0
WAIT STATES
00
0
01
1
10
2
11
3
15
14
13
12
11
10
9876543210
00000000
R7
R6
R5
R4
R3
R2
R1
R0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68EN360EM25 | 7 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP240 |
| MC68EN360FE33 | RISC MICROCONTROLLER, CQFP240 |
| MC68360RC25 | RISC MICROCONTROLLER, CPGA241 |
| MC68EN360RC25 | RISC MICROCONTROLLER, CPGA241 |
| MC68360FE25 | 32-BIT, 25 MHz, RISC PROCESSOR, CQFP240 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SPAK56854FG120 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56857BU120 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:120 MIPS Hybrid Processor |
| SPAK56F803BU80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAK56F805FV80 | 制造商:Freescale Semiconductor 功能描述: |
| SPAKDSP303AG100 | 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC SPAKDSP303AG100 RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
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