參數(shù)資料
型號： PQ2FADSVRRM
英文描述： PQ2FADS-VR Users Manual
中文描述： PQ2FADS - VR的用戶手冊
文件頁數(shù)： 93/186頁
文件大小： 2001K
代理商： PQ2FADSVRRM
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Support Information
MOTOROLA
PQ2FADS-VR User’s Manual
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81
7.1.4
P7 is a 128 pin, 90
0
, DIN 41612 connector, which allows for convenient expansion of the PQ2’s
serial ports. This connector contains all CPM pins plus power supply pins, to provide for easy tool
connection as described in
Table 7-4.
P7 - CPM Expansion Connector
5
QREQ#
O
Quiescent Request (L). When asserted (low), this line indicates that the
PQ2 desires to enter low-power mode. This signal may be required by a
debug station.
6
3v3
O
3.3V power supply bus.
7
TCK
I
Test port Clock. This clock shifts in / out data to / from the JTAG logic.
Data is driven on the falling edge of TCK and is sampled both internally
and externally on it’s rising edge.
TCK is pulled up internally by the PQ2.
8
N.C.
-
Not Connected.
9
TMS
I
Test Mode Select. This signal qualified with TCK in a same manner as
TDI, changes the state of the JTAG machine. This line is pulled up
internally by the PQ2.
10
GND
O
Digital GND. Main GND plane.
11
SRESET#
I/O, O.D.
Soft Reset (L). This is the PQ2’s soft reset which is in fact a non-
maskable interrupt, making the PPC take the reset exception from the
reset vector. This line may be driven by the PQ2 as well during soft-reset
sequence, for 512 system clocks. This line is pulled up on the ADS with
a 1K
resistor. When driven externally, it
MUST be driven with an
Open Drain gate.
Failure to do so may result in permanent damage
to the PQ2 and / or to ADS logic.
12
GND
O
Digital GND. Main GND plane.
13
HRESET#
I/O, O.D.
PQ2’s Hard Reset (L). When asserted by an external H/W, generates
Hard-Reset sequence for the PQ2. During that sequence, asserted by the
PQ2 for 512 system clocks. Pulled Up on the ADS using a 1K
resistor.
When driven by an external tool,
MUST be driven with an Open
Drain gate.
Failure to do so may result in permanent damage to the
PQ2 and / or to ADS logic.
14
N.C.
-
Not Connected.
15
XBR3#
(CKSTOP_OUT#)
I/O
Normally configured as XBR3# which has no function with this
connector. May be configured as CKSTP_OUT# - Check Stop Out (L).
When asserted (Low) indicates that the PQ2 core has entered a Check-
Stop state.
16
GND
O
Digital GND. Main GND plane.
Table 7-3. P16 - COP/JTAG Connector
Pin No.
Signal Name
Attribute
Description
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料
PDF描述
PQ2FADSZURM MPC82xx Family Application Development System Users Manual
PQ2LXXX2MSP LOW POWER-LOSS VOLTAGE REGULATOR
PQ30RF11
PQ30
PQ30RV1B Positive Adjustable Voltage Regulator
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參數(shù)描述
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PQ2L2152MSPQ 制造商:SHARP 制造商全稱:Sharp Electrionic Components 功能描述:2-Output Type Low Power-Loss Voltage Regulators
PQ2L2182MSPQ 功能描述:低壓差穩(wěn)壓器 - LDO Dual 1.8V and 2.5V 250mA/ch RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20
PQ2L3152MSPQ 功能描述:低壓差穩(wěn)壓器 - LDO FixD2output 0.25A/ch Vo=3.3V/1.5V RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20
PQ2L3182MSPQ 功能描述:低壓差穩(wěn)壓器 - LDO Dual 1.8V and 3.3V 250mA/ch RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20
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