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參數(shù)資料
| 型號： | PQ2FADSVRRM |
| 英文描述： | PQ2FADS-VR Users Manual |
| 中文描述： | PQ2FADS - VR的用戶手冊 |
| 文件頁數(shù)： | 53/186頁 |
| 文件大?。?/td> | 2001K |
| 代理商： | PQ2FADSVRRM |
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Functional Description
MOTOROLA
PQ2FADS-VR User’s Manual
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Go to: www.freescale.com
41
4.7.1
SDRAM Programming
After power-up, the SDRAM needs to be initialized by means of programming to establish its
mode of operation. The SDRAM is programmed according to the following procedure:
1. Issue Precharge-All command
2. Issue 8 CBR refresh commands
3. Issue MODE-SET command.
An SDRAM is programmed by issuing a Mode Register Set command. During that command,
data is passed to the Mode Register through the SDRAMs’ address lines. This command is fully
supported by the SDARM machine of the PQ2. Before that can take place, the SDRAM machine
of the PQ2 has to be initialized.
Mode Register programming values are shown in
Table 4-6.
:
4.7.2
SDRAM Refresh
The SDRAM is refreshed using its auto-refresh mode. I.e., using SDRAM machine one’s periodic
timer, an auto-refresh command is issued to the SDRAM every 8.2
μ
sec, so that all 4096 SDRAM
rows are refreshed within specified 34 msec, while leaving an interval of ~30 msec of refresh
redundancy within that window, as a safety measure, to cover for possible delays in bus
availability for the refresh controller.
4.7.3
L2-Cache Support Influence On SDRAM Design
To support an optional L2-Cache on the PQ2FADS-VR, the following measures need to be taken:
1. Optional Latches - Multiplexers are added over selected address lines. See
Figure 4-6.
These Latches - Multiplexers are normally by-passed by 0
resistors that are not assem-
Table 4-6. 100 MHz SDRAM Mode Register Programming
SDRAM
Address
Line
a
a. Actually SDRAMs’ A0 is connected to PQ2s’ A28 and so on...
SDRAM Mode
Reg Field
Value
Meaning:
A11 (MSB)
Reserved
’0’
A10
Reserved
’0’
A9
Opcode
’0’ / ’1’
0 - Burst Read & Burst Write (Copy-Back data cache)
1 - Burst Read & Single Write (Write-Through Data cache)
A8
Reserved
’0’
A7
Reserved
’0’
A6 - A4
CAS Latency
’011’
Data Valid 3 Clocks cycles after CAS Asserted
A3
Burst Type
’0’
Sequential Burst
A2 - A0
Burst Length
’010’
4 Operand Burst Length
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PQ2FADSZURM | MPC82xx Family Application Development System Users Manual |
| PQ2LXXX2MSP | LOW POWER-LOSS VOLTAGE REGULATOR |
| PQ30RF11 | |
| PQ30 | |
| PQ30RV1B | Positive Adjustable Voltage Regulator |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PQ2FADS-ZU | 功能描述:開發(fā)板和工具包 - 其他處理器 PQ2 FAMILY ADS-480 TBGA RoHS:否 制造商:Freescale Semiconductor 產(chǎn)品:Development Systems 工具用于評估:P3041 核心:e500mc 接口類型:I2C, SPI, USB 工作電源電壓: |
| PQ2L2152MSPQ | 制造商:SHARP 制造商全稱:Sharp Electrionic Components 功能描述:2-Output Type Low Power-Loss Voltage Regulators |
| PQ2L2182MSPQ | 功能描述:低壓差穩(wěn)壓器 - LDO Dual 1.8V and 2.5V 250mA/ch RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負(fù)載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20 |
| PQ2L3152MSPQ | 功能描述:低壓差穩(wěn)壓器 - LDO FixD2output 0.25A/ch Vo=3.3V/1.5V RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負(fù)載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20 |
| PQ2L3182MSPQ | 功能描述:低壓差穩(wěn)壓器 - LDO Dual 1.8V and 3.3V 250mA/ch RoHS:否 制造商:Texas Instruments 最大輸入電壓:36 V 輸出電壓:1.4 V to 20.5 V 回動電壓（最大值）:307 mV 輸出電流:1 A 負(fù)載調(diào)節(jié):0.3 % 輸出端數(shù)量: 輸出類型:Fixed 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-20 |
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