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參數(shù)資料
| 型號(hào)： | MT90500 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Multi-Channel ATM AAL1 SAR |
| 中文描述： | 多通道自動(dòng)柜員機(jī)AAL1特區(qū) |
| 文件頁數(shù)： | 133/159頁 |
| 文件大小： | 514K |
| 代理商： | MT90500 |
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MT90500
133
6.2.5.2
Secondary UTOPIA Interface
Table 94 - Secondary UTOPIA Parameters Timing
Characteristic
Sym
Min
Typ
Max
Units
Test Conditions
STXCLK Period
t
STXP
40
ns
STXCLK = 25 MHz
STXCLK Pulse Width (HIGH / LOW)
t
STXH/L
16
20
24
ns
Input Setup Time
- (STXDATA[7:0]
VALID; STXSOC and STXEN asserted)
to STXCLK rising
t
STXIS
10
ns
Input Hold Time
- STXCLK rising to
(STXDATA[7:0]
STXSOC and STXEN de-asserted)
INVALID
and
t
STXIH
1
ns
Output Delay
- STXCLK rising to
STXCLAV asserted
t
STXD
20
ns
C
L
= 50 pF
Output Hold Time
- STXCLK rising to
STXCLAV de-asserted
t
STXH
1
C
L
= 50 pF
NOTE:
The
MT90500
requires at least one idle cycle between cells driven into the Secondary UTOPIA interface.
V
TT
STXSOC
STXCLK
t
STXH
t
STXL
t
STXP
Figure 59 - Secondary UTOPIA Interface
V
TT
STXEN
STXDATA[7:0]
X
H1
H2
H3
X
P45
P46
at least 4 cycles before the next cell
P47
P48
V
TT
V
TT
V
TT
STXCLAV
t
STXD
t
STXIS
t
STXIH
H1
t
STXIH
t
STXIH
NOTE: STXEN must be de-asserted for at least one cycle between cells, as shown here.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT90500AL | Multi-Channel ATM AAL1 SAR |
| MT90502 | Multi-Channel AAL2 SAR(多通道 ATM AAL2分段及重組設(shè)備（基于通訊總線的系統(tǒng)與ATM網(wǎng)絡(luò)的接口）) |
| MT90732AP | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90732 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90733 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90500AL | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:Multi-Channel ATM AAL1 SAR |
| MT90500AL-ENG1 | 制造商:Mitel Networks Corporation 功能描述: |
| MT90502 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Multi-Channel AAL2 SAR |
| MT90502_06 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Multi-Channel AAL2 SAR |
| MT90502AG | 制造商:Rochester Electronics LLC 功能描述: 制造商:Zarlink Semiconductor Inc 功能描述: |
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