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參數(shù)資料
| 型號： | MPC5125YVN400 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 80/94頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT E300 324TEPBGA |
| 標準包裝： | 60 |
| 系列： | MPC51xx |
| 核心處理器： | e300 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，I²C，USB OTG |
| 外圍設(shè)備： | DMA，WDT |
| 輸入/輸出數(shù)： | 64 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.08 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 324-BBGA |
| 包裝： | 托盤 |
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Electrical and Thermal Characteristics
MPC5125 Microcontroller Data Sheet, Rev. 4
Freescale Semiconductor
81
4.3.18
IEEE 1149.1 (JTAG)
Figure 45. Timing Diagram — JTAG Clock Input
Table 48. JTAG Timing Specification
Sym
Characteristic
Min
Max
Unit
SpecID
—
TCK frequency of operation
0
25
MHz
A23.1
1
TCK cycle time
40
—
ns
A23.2
2
TCK clock pulse width measured at 1.5 V
1.08
—
ns
A23.3
3
TCK rise and fall times
0
3
ns
A23.4
4TRST setup time to TCK falling edge1
NOTES:
1 TRST is an asynchronous signal. The setup time is for test purposes only.
10
—
ns
A23.5
5TRST assert time
5
—
ns
A23.6
6
Input data setup time2
2 Non-test, other than TDI and TMS, signal input timing with respect to TCK.
5
—
ns
A23.7
7
15
—
ns
A23.8
8
TCK to output data valid3
3 Non-test, other than TDO, signal output timing with respect to TCK.
0
30
ns
A23.9
9
TCK to output high impedance3
030
ns
A23.10
10
TMS, TDI data setup time
5
—
ns
A23.11
11
TMS, TDI data hold time
4.5
—
ns
A23.12
12
TCK to TDO data valid
0
15
ns
A23.13
13
TCK to TDO high impedance
0
15
ns
A23.14
TCK
VM
3
22
1
VM = Midpoint Voltage
Numbers shown reference JTAG Timing Specification T
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