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參數(shù)資料
| 型號： | MPC5125YVN400 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 62/94頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 32BIT E300 324TEPBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | MPC51xx |
| 核心處理器： | e300 |
| 芯體尺寸： | 32-位 |
| 速度： | 400MHz |
| 連通性： | CAN，EBI/EMI，以太網(wǎng)，I²C，USB OTG |
| 外圍設(shè)備： | DMA，WDT |
| 輸入/輸出數(shù)： | 64 |
| 程序存儲器類型： | ROMless |
| RAM 容量： | 32K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.08 V ~ 3.6 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 125°C |
| 封裝/外殼： | 324-BBGA |
| 包裝： | 托盤 |
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Electrical and Thermal Characteristics
MPC5125 Microcontroller Data Sheet, Rev. 4
Freescale Semiconductor
65
Figure 27. Ethernet Timing Diagram — MII and RMII Rx Signal
Table 28. RMII Rx Signal Timing
Sym
Description
Min
Max
Unit
SpecID
t5
RXD[1:0], RX_DV, RX_ER to TX_CLK setup
4
—
ns
A11.5
t6
TX_CLK to RXD[1:0], RX_DV, RX_ER hold
2
—
ns
A11.6
t7
TX_CLK pulse width high
35%
65%
TX_CLK period1
NOTES:
1 TX_CLK frequency shall be 50 MHz regardless of the data rate. See the RMII specification.
A11.7
t8
TX_CLK pulse width low
35%
65%
TX_CLK period1
A11.8
Table 29. MII Tx Signal Timing
Sym
Description
Min
Max
Unit
SpecID
t9
TX_CLK rising edge to TXD[3:0], TX_EN, TX_ER invalid
3
—
ns
A11.9
t10
TX_CLK rising edge to TXD[3:0], TX_EN, TX_ER valid
—
25
ns
A11.10
t11
TX_CLK pulse width high
35%
65%
TX_CLK Period1
NOTES:
1 The TX_CLK frequency shall be 25% of the nominal transmit frequency, for example, a PHY operating at 100 Mb/s must
provide a TX_CLK frequency of 25 MHz and a PHY operating at 10 Mb/s must provide a TX_CLK frequency of 2.5 MHz. See
the IEEE 802.3 specification.
A11.11
t12
TX_CLK pulse width low
35%
65%
TX_CLK Period1
A11.12
Table 30. RMII Tx Signal Timing
Sym
Description
Min
Max
Unit
SpecID
t13
TX_CLK rising edge to TXD[1:0], TX_EN, TX_ER invalid
3
—
ns
A11.13
t14
TX_CLK rising edge to TXD[1:0], TX_EN, TX_ER valid
—
14
ns
A11.14
t15
TX_CLK pulse width high
35%
65%
TX_CLK Period1
NOTES:
1 TX_CLK frequency shall be 50 MHz regardless of the data rate. See the RMII specification.
A11.15
t16
TX_CLK pulse width low
35%
65%
TX_CLK Period1
A11.16
t4, t8
t3, t7
t1. t5
t2. t6
REF_CLK (Input)
RXD[3:0] (inputs)
RX_DV
RX_ER
REF_CLK is TX_CLK in RMII mode, and is RX_CLK in non-RMII mode
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
| MPC5125YVN400 | 制造商:Freescale Semiconductor 功能描述:ICMICROPROCESSOR32-BITCMOSPBGA324PI |
| MPC5125YVN400R | 制造商:Freescale Semiconductor 功能描述:POWERPC EMBEDDED SOC - Tape and Reel |
| MPC5200 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Hardware Specifications |
| MPC5200B | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SDRAM/DDR Memory Controller |
| MPC5200B_08 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:SDRAM / DDR Memory Controller |
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