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參數(shù)資料
| 型號： | MC145572 |
| 廠商： | Motorola, Inc. |
| 英文描述： | ISDN U-Interface Transceiver(ISDN U接口收發(fā)器) |
| 中文描述： | 綜合業(yè)務(wù)數(shù)字網(wǎng)U型接口收發(fā)器（綜合業(yè)務(wù)數(shù)字網(wǎng)ü接口收發(fā)器） |
| 文件頁數(shù)： | 8/264頁 |
| 文件大小： | 2832K |
| 代理商： | MC145572 |
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MC145572
Contents–iv
MOTOROLA
SECTION 8
GCI MODE FUNCTIONAL DESCRIPTION
8.1
8.2
8.3
8.3.1
8.3.2
8.3.2.1
8.3.2.2
8.3.2.3
8.3.3
8.4
8.5
8.6
FUNCTIONAL OVERVIEW
INTERFACE SIGNALS
GCI FRAME STRUCTURE
Monitor Channel Operation
Monitor Channel Messages and Commands
Monitor Channel Commands
Monitor Channel Response Messages
Monitor Channel Interrupt Indication Messages
Command/Indicate Channel Operation
GCI ACTIVATION AND DEACTIVATION TIME DIAGRAMS
GCI MASTER AND SLAVE MODE OPERATION
U–INTERFACE SUPERFRAME ALIGNMENT
8–1
8–3
8–3
8–6
8–6
8–6
8–10
8–10
8–11
8–12
8–19
8–19
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SECTION 9
MCU MODE PROGRAMMING SUGGESTIONS
9.1
9.2
9.2.1
9.2.2
9.2.3
9.3
9.4
9.5
9.6
INTRODUCTION
ACTIVATION AND INITIALIZATION
NT Automatic eoc Mode Initialization and Activation
NT Non–Automatic eoc Mode Initialization and Activation
LT Mode Initialization and Activation
TIMESLOT ASSIGNER PROGRAMMING EXAMPLE
GCI 2B+D MODE PROGRAMMING EXAMPLE
BLOCK ERROR RATIO CALCULATION USING febe/nebe COUNTERS
D CHANNEL COMMUNICATION VIA THE SERIAL OR PARALLEL CONTROL PORT
9–1
9–1
9–2
9–4
9–6
9–8
9–11
9–11
9–13
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SECTION 10
ELECTRICAL SPECIFICATIONS
10.1
10.2
10.3
10.4
10.5
10.6
10.6.1
10.6.2
10.7
10.7.1
10.7.2
10.7.3
10.7.4
10.8
10.9
10.9.1
10.9.2
10.9.3
10.9.4
ABSOLUTE MAXIMUM RATINGS
RECOMMENDED OPERATING CONDITIONS
POWER CONSUMPTION
PERFORMANCE
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DC ELECTRICAL CHARACTERISTICS
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2B1Q INTERFACE ELECTRICAL CHARACTERISTICS
Pins TxP and TxN
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Pins RxP and RxN
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IDL2 TIMING
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IDL2 Master Short Frame Sync Timing, 8– and 10–Bit and TSAC Formats
IDL2 Slave Short Frame Sync Timing, 8– and 10–Bit Formats
IDL2 Master Long Frame Sync, 8– and 10–Bit Formats
IDL2 Slave Long Frame Sync, 8– and 10–Bit Formats
GCI TIMING
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D–CHANNEL PORT TIMING
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IDL2 (Master or Slave) Short Frame Sync 8–Bit Format, D Channel Port Timing
IDL2 (Master or Slave) Short Frame Sync 10–Bit Format, D Channel Port Timing
IDL2 (Master or Slave) Long Frame Sync 8–Bit Format, D Channel Port Timing
IDL2 (Master or Slave) Long Frame Sync 10–Bit Format, D Channel Port Timing
10–1
10–1
10–1
10–1
10–2
10–2
10–2
10–2
10–3
10–3
10–5
10–7
10–8
10–10
10–12
10–12
10–14
10–16
10–18
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PDF描述 |
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參數(shù)描述 |
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