參數資料
型號: MC145572
廠商: Motorola, Inc.
英文描述: ISDN U-Interface Transceiver(ISDN U接口收發(fā)器)
中文描述: 綜合業(yè)務數字網U型接口收發(fā)器(綜合業(yè)務數字網ü接口收發(fā)器)
文件頁數: 117/264頁
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代理商: MC145572
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MC145572
7–1
MOTOROLA
When configured for MCU mode operation, the MC145572 provides a very flexible interface to the
4 kbps maintenance channel (M channel), defined in ANSI T1.601–1992. The maintenance channel
consists of 48 bits sent by both the LT and NT configured U–interface transceivers during the course
of a superframe. These 48 bits are divided into 6 subchannels, designated M1 through M6, each con-
sisting of 8 bits per superframe. The eoc consists of M1, M2, and M3. The overhead bits, such as
crc
,
febe
,
act
, and
dea
, are contained in subchannels M4, M5, and M6.
An external microcontroller can read from or write to the maintenance channel via the SCP or PCP
interfaces. Interrupts to an external microcontroller can be enabled when an eoc, M4, M5, or M6 chan-
nel register is updated. Maintenance channel registers can be configured to update when a new value
is detected between successive superframes, when a bit changes, or when two or three successive
superframes of a new value are detected. The M4 channel
act
bit, BR1(b7), can also be configured
to automatically enable or disable customer data when in NT or LT mode of operation. The M4 chan-
nel
dea
bit, BR1(b6), can also be configured to automatically issue a deactivation request in NT mode
of operation. The maintenance channel registers are updated only when Superframe Sync, NR1(b1),
is set to a 1.
Sections 7.5 and 7.6
provide information of interest to designers of LULT/LUNT (Line Unit Like–LT/
Line Unit Like–NT1) type line cards for use in digital loop carrier systems using end–to–end perfor-
mance monitoring.
See the BR9 description in
Section 4.4.10
for more details on maintenance channel register opera-
tions. Figure 7–1 shows the relationship between the received superframe and when the interrupt line
is asserted when the appropriate interrupts have been enabled.
The text in this chapter is based on an ANSI T1.601 compliant application. Due to the flexibility of
the MC145572 register interface, it can easily be used in proprietary applications.
#%
NOTE: Since the eoc register, R6, is updated after basic frames 4 and 8, IRQ2 can occur at either location, or both,
depending on the setting of BR9(B7:b6).
"$!
febe
"$!
nebe
Figure 7–1. Maintenance Channel Interrupt Timing
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PDF描述
MC145576 ISDN NT1(ISDN 網絡終端)
MC14557BCL 1-to-64 Bit Variable Length Shift Register
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