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參數(shù)資料
| 型號(hào)： | L64105 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | AUDIO/VIDEO DECODER |
| 中文描述： | 音頻/視頻解碼器 |
| 文件頁數(shù)： | 36/454頁 |
| 文件大小： | 4554K |
| 代理商： | L64105 |
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2-6
I/O Signal Descriptions
CH_DATA[7:0] Channel Data Bus
The CH_DATA bus is used to transfer 8-bit, parallel
bitstreams into the L64105. The maximum transfer rate
over this interface is 20 Mbps in worst case conditions.
The peak data rate may increase above this rate
depending on system SDRAM usage.
Input
AVALIDn
Audio Data Valid
The channel device asserts this signal in response to
AREQn when the data byte it placed on the CH_DATA
bus is valid. The L64105 transfers the byte in when
AVALIDn is deasserted. This signal can be used with the
DCK input for synchronous transfers.
Input
VVALIDn
Video Data Valid
The channel device asserts this signal in response to
VREQn when the data byte it placed on the CH_DATA
bus is valid. The L64105 transfers the byte in when
VREQn is deasserted. This signal can be used with the
DCK input for synchronous transfers. This signal is used
only in the A/V PES stream mode when the channel input
is a program from a transport stream demultiplexer. Use
the AVALIDn signal for all data bytes in program stream
modes.
Input
ERRORn
Bitstream Error
ERRORn is asserted by the channel device to signal
uncorrectable errors in the bitstream and is used by the
L64105 to invoke error handling routines. It is latched by
the L64105 on the rising edge of AVALIDn or VVALIDn.
Input
DCK
Channel Clock
The DCK is a free-running clock from the external
channel device. It must have a period
≥
3 x that of
SYSCLK (27 MHz). DCK, together with the AVALIDn and
VVALIDn signals, is used to write data synchronously to
the L64105 channel input.
Input
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| L7113SEC-H | T-1 3/4 (5mm) LED LAMP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| L64111QC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Audio Decoder & Support |
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| L64133-10GC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Arithmetic Processor |
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