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參數(shù)資料
| 型號： | L64105 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | AUDIO/VIDEO DECODER |
| 中文描述： | 音頻/視頻解碼器 |
| 文件頁數(shù)： | 166/454頁 |
| 文件大小： | 4554K |
| 代理商： | L64105 |
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4-84
Register Descriptions
Figure 4.126 Register 362 (0x16A) PCM Scale [7:0]
This is an 8-bit, fractional, scale factor for scaling output PCM. PCM
Scale = 0x00 mutes the audio output; PCM Scale = 0xFF keeps the
output PCM scaled as decoded. Intermediate values (0x01, ..., 0xFE)
scale the output PCM by factors of 2/256 to 255/256.The default value
of this register is 0xFF.
Figure 4.127 Register 363 (0x16B)
ACLK Select[1:0]
R/W [1:0]
These bits select the external audio clock used for
generating the DAC and S/P DIF clocks. Note that N in
the table below stands for 768, 512, 384, or 256
according to the ACLK_ multiple(s) provided. See also
the ACLK Divider Select bits, bits [3:0] in Register 364.
The default value is 0b01 (48 kHz).
Invert LRCLK
R/W 2
The audio LRCLK output signal polarity indicates to the
external audio DAC to which channel, left or right, the
current audio sample belongs. The default setting of this
bit is 0 which means that right samples are output when
LRCLK is high and left samples are output when LRCLK
is low. Setting this bit inverts the LRCLK sense. Set or
clear this bit according to the requirements of your audio
DAC.
Reserved
[5:3]
Clear these bits when writing to this register.
7
0
PCM Scale [7:0]
R/W
7
6
5
3
2
1
0
Valid
User
Reserved
Invert LRCLK
ACLK Select [1:0]
ACLK Select
External Clock Used
0b00
0b01
0b10
0b11
ACLK_441 (44.1 kHz * N)
ACLK_48 (48 kHz * N)
ACLK_32 (32 kHz * N)
Reserved
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| L680 | Gallium Arsenide Schottky Rectifier |
| L7113SEC-H | T-1 3/4 (5mm) LED LAMP |
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| L7113VGE | T-1 3/4 GREEN LAMP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| L64111 | 制造商:LSI 制造商全稱:LSI 功能描述:MPEG AUDIO DECODER TECHNICAL MANUAL |
| L64111QC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Digital Audio Decoder & Support |
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| L64133-10GC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Arithmetic Processor |
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