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參數(shù)資料
| 型號(hào)： | DS34T104GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁(yè)數(shù)： | 20/366頁(yè) |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 484TEBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 30 |
| 類型： | TDM（分時(shí)復(fù)用） |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-TEBGA（23x23） |
| 包裝： | 托盤(pán) |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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Table 10-40. Registers Related to Signaling
Register Name
Description
Functions
Page
Tx Signaling Registers 1 to 16
Tx ABCD signaling to be inserted
Tx Signaling Insertion Enable Registers 1 to 4
Tx per-channel SW sig. insert controls
Tx Hardware Signaling Channel Select 1 to 4
Tx per-channel HW sig. insert controls
Rx Signaling Control Register
Rx auto and manual signaling freeze
Rx Signaling All-Ones Insertion Registers 1 to 3
Rx per-channel sig. all-1s insertion
Rx Signaling Registers 1 to 16
Rx ABCD signaling bits received
Rx Signaling Status Registers 1 to 4
Rx per-channel sig. change status
Rx Signaling Change of State Enable 1 to 4
Rx per-channel sig. interrupt enables
Rx Latched Status Register 4
Rx top-level sig. change latched status
Rx Interrupt Mask Register 4
Rx top-level sig. change interrupt mask
Rx Signaling Reinsertion Registers 1 to 4
Rx per-channel reinsertion control
10.11.3.1 Transmit Signaling Operation
There are two methods to provide transmit signaling data: software (i.e. from the TS registers) and hardware (i.e.
from the formatter’s TSIG input). Both methods may be used simultaneously. The methods are described in the
subsections below.
10.11.3.1.1 Software Signaling
In the software signaling method, signaling data is loaded into the transmit signaling registers (TS1 - TS16) by the
CPU. Each transmit signaling register contains the signaling bits for two DS0 timeslots. On multiframe boundaries,
the signaling bits stored in these registers are loaded into a shift register for placement in the appropriate bit
position in the outgoing data stream. The CPU can watch for the setting of the TLS1.TMF latched status bit on
multiframe boundaries to know when to update any Tx signaling bits that may need to be changed.
Signaling data can be sourced from the TS registers on a per-channel basis by using the TSSIE registers.
In T1 ESF framing mode, there are four signaling bits per channel (A, B, C, and D). TS1 - TS12 contain a full
multiframe of signaling data. In T1 D4 framing mode, there are only two signaling bits per channel (A and B), and
the C and D bit positions in the TS registers are ignored. In T1 mode, software signaling is enabled by setting
TCR1-T1.TSSE=1. When software signaling is enabled, signaling bits are sourced from the TS registers for each
channel where the appropriate bit is set to 1 in the TSSIE registers.
In E1 mode, timeslot 16 carries the signaling information. This information can be in either CCS (Common Channel
Signaling) or CAS (Channel Associated Signaling) format. Only CAS is supported by the signaling logic described
in this section. In E1 mode the TCR1-E1.T16S bit specifies how Tx signaling is sourced. When T16S=1, CAS
signaling bits for all timeslots is unconditionally sourced from the TS registers. When T16S=0, signaling bits are
sourced from the TS registers for each channel where the appropriate bit is set to 1 in the TSSIE registers. This
latter mode allows some signaling data for some channels to be sourced from the TS registers while signaling data
for other channels can be sourced from the formatters TSIG input (hardware-based signaling).
Note that in E1 the 32 timeslots are referenced by two different channel number schemes in E1. In “channel”
numbering, TS0 through TS31 are labeled channels 1 through 32. In “phone channel” numbering, TS1 through
TS15 are labeled channels 1 through 15, and TS17 through TS31 are labeled channels 16 through channel 30.
This is illustrated below.
Table 10-41. Timeslot Number Schemes
TS
0
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31
Channel 1
2
3
4
5
6
7
8
9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32
Phone
Channel
1
2
3
4
5
6
7
8
9 10 11 12 13 14 15
16 17 18 19 20 21 22 23 24 25 26 27 28 29 30
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
| MIC2211-GPYML TR | IC REG LDO 1.8V/3V 10-MLF |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DS34T104GN+ | 功能描述:通信集成電路 - 若干 Quad TDM Over Packet Chip RoHS:否 制造商:Maxim Integrated 類型:Transport Devices 封裝 / 箱體:TECSBGA-256 數(shù)據(jù)速率:100 Mbps 電源電壓-最大:1.89 V, 3.465 V 電源電壓-最小:1.71 V, 3.135 V 電源電流:50 mA, 225 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝:Tube |
| DS34T108 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T108DK-L1 | 功能描述:以太網(wǎng)開(kāi)發(fā)工具 RoHS:否 制造商:Micrel 產(chǎn)品:Evaluation Boards 類型:Ethernet Transceivers 工具用于評(píng)估:KSZ8873RLL 接口類型:RMII 工作電源電壓: |
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