參數(shù)資料
型號： DS34T104GN+
廠商： Maxim Integrated Products
文件頁數(shù)： 133/366頁
文件大?。?/td> 0K
描述： IC TDM OVER PACKET 484TEBGA
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 30
類型： TDM（分時復用）
應用： 數(shù)據(jù)傳輸
安裝類型： 表面貼裝
封裝/外殼： 484-BGA
供應商設備封裝： 484-TEBGA（23x23）
包裝： 托盤
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
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The MAC_PHY_maintenance register below enables the MAC to communicate with a PHY by means of the MDIO
interface. It is used during auto negotiation to ensure that the MAC and the PHY are configured for the same speed
and duplex configuration.
The PHY maintenance register is implemented as a shift register. Writing to the register starts a shift operation
which is signaled as complete when the PHY_access_has_completed bit is set in the
3
MAC_network_status register
(about 2000 CLK_SYS cycles later). An interrupt is generated as this bit is set. During this time, the MSB of the
register is output on the MDIO pin and the LSB is updated from the MDIO pin with each MDC cycle. In this way a
PHY management packet is transmitted on MDIO. See Section 22.2.4.5 of the IEEE 802.3 standard. Reading
during the shift operation (not recommended) returns the current contents of the shift register.
At the end of the shift operation, the bits have shifted back to their original locations. For a read operation, the data
bits are updated with data read from the PHY. It is important to write the correct values to the register to ensure a
valid PHY management packet is produced.
MAC_PHY_maintenance 0x034
Bits
Data Element Name
R/W
Reset
Value
Description
[31:30]
Start_of_packet
R/W
0x0
Must be written 01 for a valid packet
[29:28]
Operation
R/W
0x0
00 = Reserved
01 = Write
10 = Read
11 = Reserved
[27:23]
PHY_address
R/W
0x0
Specifies the PHY to access
[22:18]
Register_address
R/W
0x0
Specifies the register in the PHY to access
[17:16]
Must_be_written_to_10
R/W
0x0
Read as written
[15:0]
PHY_data
R/W
0x0000
For a write operation this field is the data to be written to
the PHY. After a read operation this field contains the data
read from the PHY
MAC_pause_time 0x038
Bits
Data Element Name
R/W
Reset
Value
Description
[31:16]
Reserved
RO
0x0000
Read 0, ignored on write
[15:0]
Pause time
RO
0x0000
Stores the current value of the pause time register, which
is decremented every 512 bit times.
MAC_specific_address_lower 0x098
Bits
Data Element Name
R/W
Reset
Value
Description
[31:0]
MAC Specific Address [31:0]
R/W
0x0
Least significant bits of the MAC specific address, i.e. bits
31:0. This field is used for transmission of pause packets
as described in section 10.6.12.2.
MAC_specific_address_upper 0x09C
Bits
Data Element Name
R/W
Reset
Value
Description
[31:16]
Reserved
RO
0x0000
Read 0, ignored on write
[15:0]
MAC Specific Address [47:32]
R/W
0x0000
Most significant bits of the MAC specific address, i.e. bits
47:32. See MAC_specific_address_lower for details.
相關PDF資料
PDF描述
DS34T101GN+ IC TDM OVER PACKET 484TEBGA
MIC2211-GOYML TR IC REG LDO 1.8V/2.9V 10-MLF
MIC2211-GJYML TR IC REG LDO 1.8V/2.5V 10-MLF
MIC2211-SGYML TR IC REG LDO 3.3V/1.8V 10-MLF
MIC2211-GPYML TR IC REG LDO 1.8V/3V 10-MLF
相關代理商/技術參數(shù)
參數(shù)描述
DS34T104GN+ 功能描述:通信集成電路 - 若干 Quad TDM Over Packet Chip RoHS:否 制造商:Maxim Integrated 類型:Transport Devices 封裝 / 箱體:TECSBGA-256 數(shù)據(jù)速率:100 Mbps 電源電壓-最大:1.89 V, 3.465 V 電源電壓-最小:1.71 V, 3.135 V 電源電流:50 mA, 225 mA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝:Tube
DS34T108 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip
DS34T108DK-L1 功能描述:以太網(wǎng)開發(fā)工具 RoHS:否 制造商:Micrel 產品:Evaluation Boards 類型:Ethernet Transceivers 工具用于評估:KSZ8873RLL 接口類型:RMII 工作電源電壓:
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