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參數(shù)資料
| 型號(hào)： | DS34T104GN+ |
| 廠商： | Maxim Integrated Products |
| 文件頁(yè)數(shù)： | 175/366頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC TDM OVER PACKET 484TEBGA |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 30 |
| 類型： | TDM（分時(shí)復(fù)用） |
| 應(yīng)用： | 數(shù)據(jù)傳輸 |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 484-BGA |
| 供應(yīng)商設(shè)備封裝： | 484-TEBGA（23x23） |
| 包裝： | 托盤 |
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____________________________________________________ DS34T101, DS34T102, DS34T104, DS34T108
256 of 366
Register Name:
RLS3-E1
Register Description:
Receive Latched Status Register 3 (E1 Mode)
Register Address:
base address + 0x248
Bit #
7
6
5
4
3
2
1
0
Name
LORCC
-
V52LNKC
RDMAC
LORCD
-
V52LNKD
RDMAD
Default
0
Note: This register has an alternate definition for E1 mode. See RLS3-T1.
Bit 7: Loss of Receive Clock Clear (LORCC). This latched status bit is set to 1 when RRTS3-E1.LORC changes
state from high to low. LORCC is cleared when written with a 1. When LORCC is set it can cause an interrupt
request if the LORCC interrupt enable bit is set in the RIM3-E1 register.
Bit 5: V5.2 Link Detected Clear (V52LNKC). This latched status bit is set to 1 when RRTS3-E1.V52LNK changes
state from high to low. V52LNKC is cleared when written with a 1. When V52LNKC is set it can cause an interrupt
request if the V52LNKC interrupt enable bit is set in the RIM3-E1 register.
Bit 4: Receive Distant MF Alarm Clear (RDMAC). This latched status bit is set to 1 when RRTS3-E1.RDMA
changes state from high to low. RDMAC is cleared when written with a 1. When RDMAC is set it can cause an
interrupt request if the RDMAC interrupt enable bit is set in the RIM3-E1 register.
Bit 3: Loss of Receive Clock Detect (LORCD). This latched status bit is set to 1 when RRTS3-E1.LORC changes
state from low to high. LORCD is cleared when written with a 1. When LORCD is set it can cause an interrupt
request if the LORCD interrupt enable bit is set in the RIM3-E1 register.
Bit 1: V5.2 Link Detect (V52LNKD). This latched status bit is set to 1 when RRTS3-E1.V52LNK changes state
from low to high. V52LNKD is cleared when written with a 1. When V52LNKD is set it can cause an interrupt
request if the V52LNKD interrupt enable bit is set in the RIM3-E1 register.
Bit 0: Receive Distant MF Alarm Detect (RDMAD). This latched status bit is set to 1 when RRTS3-E1.RDMA
changes state from low to high. RDMAD is cleared when written with a 1. When RDMAD is set it can cause an
interrupt request if the RDMAD interrupt enable bit is set in the RIM3-E1 register.
Register Name:
RLS4
Register Description:
Receive Latched Status Register 4
Register Address:
base address + 0x24C
Bit #
7
6
5
4
3
2
1
0
Name
RESF
RESEM
RSLIP
-
RSCOS
1SEC
TIMER
RMF
Default
0
Bit 7: Receive Elastic Store Full Event (RESF). This latched status bit is set to 1 when the receive elastic store
buffer fills and a frame is deleted. RESF is cleared when written with a 1. When RESF is set it can cause an
interrupt request if the corresponding interrupt enable bit is set in the RIM4 register. See Section 10.10.
Bit 6: Receive Elastic Store Empty Event (RESEM). This latched status bit is set to 1 when the receive elastic
store buffer empties and a frame is repeated. RESEM is cleared when written with a 1. When RESEM is set it can
cause an interrupt request if the corresponding interrupt enable bit is set in the RIM4 register. See Section 10.10.
Bit 5: Receive Elastic Store Slip Occurrence Event (RSLIP). This latched status bit is set to 1 when the receive
elastic store has either repeated or deleted a frame (i.e. either RESF or RESEM set). RSLIP is cleared when
written with a 1. When RSLIP is set it can cause an interrupt request if the corresponding interrupt enable bit is set
Bit 3: Receive Signaling Change Of State Event (RSCOS). This latched status bit is set to 1 when any channel
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PDF描述 |
|---|---|
| DS34T101GN+ | IC TDM OVER PACKET 484TEBGA |
| MIC2211-GOYML TR | IC REG LDO 1.8V/2.9V 10-MLF |
| MIC2211-GJYML TR | IC REG LDO 1.8V/2.5V 10-MLF |
| MIC2211-SGYML TR | IC REG LDO 3.3V/1.8V 10-MLF |
| MIC2211-GPYML TR | IC REG LDO 1.8V/3V 10-MLF |
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參數(shù)描述 |
|---|---|
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| DS34T108 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T108DK-L1 | 功能描述:以太網(wǎng)開(kāi)發(fā)工具 RoHS:否 制造商:Micrel 產(chǎn)品:Evaluation Boards 類型:Ethernet Transceivers 工具用于評(píng)估:KSZ8873RLL 接口類型:RMII 工作電源電壓: |
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