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參數(shù)資料
| 型號： | DDP3300A |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 英文描述： | Single-Chip Display and Deflection Processor |
| 中文描述： | 單芯片顯示器和偏轉(zhuǎn)處理器 |
| 文件頁數(shù)： | 39/53頁 |
| 文件大?。?/td> | 1767K |
| 代理商： | DDP3300A |
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DDP 3300 A
PRELIMINARY DATA SHEET
MICRONAS INTERMETALL
39
4.6.5. Bus Inputs: Luma, Chroma, OSD, Front Sync
(see Fig. 4–17)
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IL
Input Low Voltage
Y[0..7]
C[0 7]
C[0..7]
OSD[0:4]
FSY
–
–
0.8
V
V
IH
Input High Voltage
1.5
–
–
V
t
IS
Input Setup Time
7
–
–
ns
t
IH
Input Hold Time
–
–
6
ns
Data Inputs
Y,C,RGB,Fsync
Main Clock
t
IS
t
IH
Fig. 4–17:
Picture bus input timing
4.6.6. 20.25 MHz Main Clock Input, internally AC coupled
(see Fig. 4–18)
Symbol
Parameter
Pin Name
Min.
Typ.
Max.
Unit
Test Conditions
V
IT
Input Trigger Level
CLK20
2.1
2.5
2.9
V
f
Φ
Φ
Main Clock Frequency
10
20.25
24
MHz
V
Φ
MIDC
Φ
Main Clock Input DC Volt-
age
1.0
–
3.5
V
V
Φ
MIAC
Φ
M Clock Input AC Voltage
(p–p)
0.8
–
2.5
V
t
Φ
MIH
t
Φ
MIL
Φ
M Clock Input High/Low
Ratio
0.9
1.0
1.1
t
Φ
MIHL
Φ
M Clock Input High to Low
Transition Time
–
–
0.15
f
Φ
M
t
Φ
MILH
Φ
M Clock Input Low to High
Transition Time
–
–
0.15
f
Φ
M
t
Φ
MILH
0 V
DVSS
V
Φ
MIDC
V
Φ
MIAC
t
Φ
MIHL
t
Φ
MIH
t
Φ
MIL
Fig. 4–18:
Main clock input
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DDP3310B | Display and Deflection Processor |
| DDR-TJS-T2 | LED AlInGaP |
| DD0-SJS-S1 | LED AlInGaP |
| DD0-SJS-S2 | LED AlInGaP |
| DD0-SJS-T1 | LED AlInGaP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DDP3300A(DIP64) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Consumer IC |
| DDP3300A(PLCC68) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:TV/Video Signal Processor |
| DDP3300A(SDIP64) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:TV/Video Signal Processor |
| DDP3300AD3 | 制造商:MICRONAS 功能描述:New |
| DDP3300APSD3 | 制造商:MICRONAS 功能描述:New |
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