參數(shù)資料
型號： C8051F2XX
廠商： Electronic Theatre Controls, Inc.
英文描述： Mixed Signal 8 kB ISP Flash MCU Family
中文描述： 混合信號8 KB的閃存MCU系列的ISP
文件頁數(shù)： 114/146頁
文件大小： 1856K
代理商： C8051F2XX
C8051F2xx
114
Rev. 1.6
SFR Definition 15.1. SPI0CFG: SPI Configuration
Bit7:
CKPHA: SPI Clock Phase.
This bit controls the SPI clock phase.
0: Data sampled on first edge of SCK period.
1: Data sampled on second edge of SCK period.
Bit6:
CKPOL: SPI Clock Polarity.
This bit controls the SPI clock polarity.
0: SCK line low in idle state.
1: SCK line high in idle state.
Bits5–3:
BC2–BC0: SPI Bit Count.
Indicates which of the up to 8 bits of the SPI word have been transmitted.
Bits2–0:
SPIFRS2–SPIFRS0: SPI Frame Size.
These three bits determine the number of bits to shift in/out of the SPI shift register during a
data transfer in master mode. They are ignored in slave mode.
R/W
R/W
R
R
R
R/W
R/W
R/W
Reset Value
CKPHA
Bit7
CKPOL
Bit6
BC2
Bit5
BC1
Bit4
BC0
Bit3
SPIFRS2 SPIFRS1 SPIFRS0
Bit2
Bit1
00000111
Bit0
SFR Address:
0x9A
BC2
–
BC0
0
0
1
1
0
0
1
1
Bit Transmitted
Bit 0 (LSB)
Bit 1
Bit 2
Bit 3
Bit 4
Bit 5
Bit 6
Bit 7 (MSB)
0
0
0
0
1
1
1
1
0
1
0
1
0
1
0
1
SPIFRS
0
0
1
1
0
0
1
1
Bits Shifted
1
2
3
4
5
6
7
8
0
0
0
0
1
1
1
1
0
1
0
1
0
1
0
1
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PDF描述
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