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參數(shù)資料
| 型號： | AD9146BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 48/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 16BIT SRL DUAL 48LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | TxDAC+® |
| 設(shè)置時間： | 20ns |
| 位數(shù)： | 16 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 2 |
| 電壓電源： | 模擬和數(shù)字 |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-WFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 48-LFCSP-WQ（7x7） |
| 包裝： | 托盤 |
| 輸出數(shù)目和類型： | 2 電流，單極 |
| 采樣率（每秒）： | 1.23G |
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AD9146
Data Sheet
Rev. A | Page 52 of 56
EXAMPLE START-UP ROUTINE
To ensure reliable start-up of the AD9146, certain sequences
should be followed. This section shows an example start-up
routine. This example uses the configuration described in the
Device Configuration section.
DEVICE CONFIGURATION
The following device configuration is used for this example.
fDATA = 122.88 MSPS
Interpolation is 4×, using HB1 = 10 and HB2 = 010010
Input data is baseband data
fOUT = 140 MHz
fREFCLK = 122.88 MHz
PLL is enabled
Inverse sinc filter is enabled
Synchronization is enabled
DERIVED PLL SETTINGS
The following PLL settings can be derived from the device
configuration.
fDACCLK = fDATA × interpolation = 491.52 MHz
fVCO = 4 × fDACCLK = 1966.08 MHz (1 GHz < fVCO < 2 GHz)
N1 = fDACCLK/fREFCLK = 4
N2 = fVCO/fDACCLK = 4
START-UP SEQUENCE
The following sequence configures the power clock and register
write sequencing for reliable device start-up.
Power up Device (no specific power supply
sequence is required)
Apply stable REFCLK input signal.
Apply stable DCI input signal.
Device Configuration Register Write Sequence:
0x00
0x20 /* Issue Software Reset */
0x00
0x80 /* Enable 3-wire SPI */
0x1E
0x01
/* Start PLL */
0x0C
0xE1
0x0D
0xD9
0x0A
0xCF
0x0A
0xA0
/* Verify PLL is Locked */
Read 0x0E
/* Expect bit 7 = 0, bit 6 = 1 */
Read 0x06
/* Expect 0x5C */
0x10
0x48 /* Choose Data Rate Mode */
0x17
0x04 /* Issue Software FIFO Reset */
0x18
0x02
0x18
0x00
/* Verify FIFO Reset */
Read 0x18
/* Expect 0x05 */
Read 0x19
/* Expect 0x07 */
0x1B
0xA4 /* Enable Inverse Sinc */
/* Configure Interpolation Filters */
0x1C
0x04
0x1D
0x24
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| GTC02R-36-5P | CONN RCPT 4POS BOX MNT W/PINS |
| VE-2TY-MX-F2 | CONVERTER MOD DC/DC 3.3V 49.5W |
| MS27508E24B4PC | CONN RCPT 56POS BOX MNT W/PINS |
| VE-2TY-MW-F2 | CONVERTER MOD DC/DC 3.3V 66W |
| MS27508E24B4PB | CONN RCPT 56POS BOX MNT W/PINS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AD9146BCPZRL | 功能描述:IC DAC 16BIT SRL DUAL 48LFCSP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:TxDAC+® 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1,000 系列:- 設(shè)置時間:1µs 位數(shù):8 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:8 電壓電源:雙 ± 功率耗散（最大）:941mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:24-SOIC W 包裝:帶卷 (TR) 輸出數(shù)目和類型:8 電壓，單極 采樣率（每秒）:* |
| AD9146-EBZ | 制造商:Analog Devices 功能描述:16 BIT DUAL SIGNAL PROC DAC EB - Boxed Product (Development Kits) |
| AD9146-M5375-EBZ | 功能描述:BOARD EVAL FOR AD9146 DAC RoHS:是 類別:編程器，開發(fā)系統(tǒng) >> 評估板 - 數(shù)模轉(zhuǎn)換器 (DAC) 系列:TxDAC+® 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1 系列:- DAC 的數(shù)量:4 位數(shù):12 采樣率（每秒）:- 數(shù)據(jù)接口:串行，SPI? 設(shè)置時間:3µs DAC 型:電流/電壓 工作溫度:-40°C ~ 85°C 已供物品:板 已用 IC / 零件:MAX5581 |
| AD9148 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Quad 16-Bit,1 GSPS, TxDAC+ Digital-to-Analog Converter |
| AD9148ARUZ | 制造商:Analog Devices 功能描述:- Rail/Tube |
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