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參數(shù)資料
| 型號(hào)： | AD14060LBF-4 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 37/48頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CMOS 32BIT 308CQFP |
| 產(chǎn)品培訓(xùn)模塊： | SHARC Processor Overview |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | SHARC® |
| 類型： | 浮點(diǎn) |
| 接口： | 主機(jī)接口，連接端口，串行端口 |
| 時(shí)鐘速率： | 40MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 2MB |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 3.30V |
| 工作溫度： | -40°C ~ 100°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 308-CBQFP |
| 供應(yīng)商設(shè)備封裝： | 308-CQFP（52x52） |
| 包裝： | 托盤 |
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AD14060/AD14060L
Rev. B | Page 42 of 48
SHARC_A
TDI
TDO
TCK
TMS
EMULATOR
JTAG
CONNECTOR
TDI
TCK
TMS
EMU
TRST
TDO
CLKIN
OTHER JTAG
CONTROLLER
OPTIONAL
SHARC_B
TDI
TDO
TCK
TMS
EM
U
TRST
SHARC_C
TDI
TDO
TCK
TMS
EM
U
TRST
SHARC_D
TDI
TDO
TCK
TMS
EM
U
TRST
JTAG DEVICE
(OPTIONAL)
TDI
TDO
TCK
TMS
TRST
ADSP-2106x
#n
TDI
TDO
TCK
TMS
EM
U
TRST
EM
U
TRST
00667-009
Figure 27. JTAG Scan Path Connections for the AD14060/AD14060L
SYSTEM
CLKIN
1
TDI
TDO
TDI
TDO
TDI
TDO
TDI
TDO
TDI
TDO
TDI
TDO
TDI
EMU
TMS
TCK
TDO
TRST
CLKIN
5k
1
5k
1OPEN-DRAIN DRIVER OR EQUIVALENT, THAT IS:
EMU
00667-010
Figure 28. JTAG Clock Tree for Multiple ADSP-2106x Systems
OUTPUT DRIVE CURRENTS
Figure 29 shows typical I-V characteristics for the output
drivers of the ADSP-2106x. The curves represent the current
drive capability of the output drivers as a function of output
voltage.
00667-029
SOURCE VOLTAGE (V)
5
01
2
3
4
S
O
URCE
CURRE
NT
(mA)
120
60
80
100
20
40
–40
–20
0
–80
–60
–140
–120
–100
–160
HIGH LEVEL DRIVE
(P DEVICE)
LOW LEVEL DRIVE
(N DEVICE)
Figure 29. ADSP-2106x Typical Drive Currents (VDD = 5 V)
POWER DISSIPATION
Total power dissipation has two components, one due to
internal circuitry and one due to the switching of external
output drivers. Internal power dissipation is dependent on the
instruction execution sequence and the data operands involved.
Internal power dissipation is calculated as follows:
PINT = IDDIN × VDD
The external component of total power dissipation is caused by
the switching of output pins. Its magnitude depends on the
following:
Number of output pins that switch during each cycle (O)
Maximum frequency at which they can switch (f)
Load capacitance (C)
Voltage swing (V
DD
)
and is calculated by
PEXT = O × C × VDD2 × f
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