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參數(shù)資料
| 型號(hào)： | XRT83L34IV-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 15/99頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1/J1 QUAD 128TQFP |
| 標(biāo)準(zhǔn)包裝： | 72 |
| 類(lèi)型： | 線路接口裝置（LIU） |
| 驅(qū)動(dòng)器/接收器數(shù)： | 4/4 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應(yīng)商設(shè)備封裝： | 128-TQFP（14x20） |
| 包裝： | 托盤(pán) |
| 其它名稱(chēng)： | XRT83L34IV-F-ND |
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XRT83L34
xr
REV. 1.0.1
QUAD T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
19
JITTER ATTENUATOR
SIGNAL NAME
PIN #
TYPE
DESCRIPTION
JASEL0
JASEL1
A[6]
A[5]
58
57
58
I
Jitter Attenuator Select Pins - Hardware Mode
Jitter Attenuator select pin 0
Jitter Attenuator select pin 1
JASEL[1:0] pins are used to place the jitter attenuator in the transmit path,
the receive path or to disable it.
Microprocessor Address Bits A[6:5] -Host Mode
NOTE: Internally pulled “Low” with a 50k
resistor.
Disabled
Transmit
Receive
JA Path
JA BW
MHz
T1/E1
32/32
64/64
FIFO Size
T1
3
E1
10
1.5
0
JASEL1
0
1
JASEL0
Disabled
Transmit
Receive
JA Path
JA BW Hz
--------
32/32
64/64
FIFO Size
-----
3
-----
10
1.5
0
1
JASEL1
0
1
0
1
JASEL0
T1
E1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT83L38IB-F | IC LIU T1/E1/J1 OCTAL 225BGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT83L34IVTR | 功能描述:外圍驅(qū)動(dòng)器與原件 - PCI RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
| XRT83L34IVTR-F | 功能描述:外圍驅(qū)動(dòng)器與原件 - PCI RoHS:否 制造商:PLX Technology 工作電源電壓: 最大工作溫度: 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FCBGA-1156 封裝:Tray |
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