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參數(shù)資料
| 型號(hào)： | XC3S200A-4VQ100I |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 88/132頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SPARTAN 3 100VQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | Spartan®-3A |
| LAB/CLB數(shù)： | 448 |
| 邏輯元件/單元數(shù)： | 4032 |
| RAM 位總計(jì)： | 294912 |
| 輸入/輸出數(shù)： | 68 |
| 門數(shù)： | 200000 |
| 電源電壓： | 1.14 V ~ 1.26 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 100-TQFP |
| 供應(yīng)商設(shè)備封裝： | 100-VQFP（14x14） |
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DC and Switching Characteristics
DS529-3 (v2.0) August 19, 2010
59
Serial Peripheral Interface (SPI) Configuration Timing
Figure 14: Waveforms for Serial Peripheral Interface (SPI) Configuration
Table 52: Timing for Serial Peripheral Interface (SPI) Configuration Mode
Symbol
Description
Minimum
Maximum
Units
TCCLK1
Initial CCLK clock period
See Table 46
TCCLKn
CCLK clock period after FPGA loads ConfigRate bitstream option setting
See Table 46
TMINIT
Setup time on VS[2:0] variant-select pins and M[2:0] mode pins before the
rising edge of INIT_B
50
–ns
TINITM
Hold time on VS[2:0] variant-select pins and M[2:0] mode pins after the
rising edge of INIT_B
0
–ns
TCCO
MOSI output valid delay after CCLK falling clock edge
See Table 50
TDCC
Setup time on the DIN data input before CCLK rising clock edge
See Table 50
TCCD
Hold time on the DIN data input after CCLK rising clock edge
See Table 50
T
DH
T
DSU
Command
(msb)
T
V
T
CSS
<1:1:1>
INIT_B
M[2:0]
T
MINIT
T
INITM
DIN
CCLK
(Input)
T
CCLK
n
T
CCLK1
VS[2:0]
(Input)
New ConfigRate active
Mode input pins M[2:0] and variant select input pins VS[2:0] are sampled when INIT_B
goes High. After this point, input values do not matter until DONE goes High, at which
point these pins become user-I/O pins.
<0:0:1>
Pin initially pulled High by internal pull-up resistor if PUDC_B input is Low.
Pin initially high-impedance (Hi-Z) if PUDC_B input is High. External pull-up resistor required on CSO_B.
T
CCLK1
T
MCCL
n
T
MCCH
n
(Input)
Data
CSO_B
MOSI
T
CCO
T
MCCL1
T
MCCH1
T
DCC
T
CCD
(Input)
PROG_B
PUDC_B
(Input)
PUDC_B must be stable before INIT_B goes High and constant throughout the configuration process.
DS529-3_06_102506
(Open-Drain)
Shaded values indicate specifications on attached SPI Flash PROM.
Command
(msb-1)
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PDF描述 |
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