參數(shù)資料
型號： TMS32C5402PGER10G4
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： FIXED-POINT DIGITAL SIGNAL PROCESSOR
中文描述： 定點數(shù)字信號處理器
文件頁數(shù)： 52/68頁
文件大小： 948K
代理商： TMS32C5402PGER10G4
SPRS079E – OCTOBER 1998 – REVISED AUGUST 2000
52
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
instruction acquisition (IAQ), interrupt acknowledge (IACK), external flag (XF), and TOUT timings
switching characteristics over recommended operating conditions for IAQ and IACK
[H = 0.5 t
c(CO)
] (see Figure 25)
PARAMETER
MIN
MAX
UNIT
td(CLKL-IAQL)
td(CLKL-IAQH)
td(A)IAQ
td(CLKL-IACKL)
td(CLKL-IACKH)
td(A)IACK
th(A)IAQ
th(A)IACK
tw(IAQL)
tw(IACKL)
Delay time, CLKOUT low to IAQ low
–1
3
ns
Delay time, CLKOUT low to IAQ high
–1
3
ns
Delay time, address valid to IAQ low
1
ns
Delay time, CLKOUT low to IACK low
–1
3
ns
Delay time , CLKOUT low to IACK high
–1
3
ns
Delay time, address valid to IACK low
3
ns
Hold time, IAQ high after address invalid
–2
ns
Hold time, IACK high after address invalid
–2
ns
Pulse duration, IAQ low
2H–2
ns
Pulse duration, IACK low
2H–2
ns
MSTRB
IACK
IAQ
A[19:0]
CLKOUT
td(A)IACK
td(A)IAQ
tw(IACKL)
th(A)IACK
td(CLKL-IACKL)
tw(IAQL)
th(A)IAQ
td(CLKL-IAQL)
td(CLKL-IACKH)
td(CLKL-IAQH)
Figure 25. IAQ and IACK Timings
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PDF描述
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參數(shù)描述
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