參數(shù)資料
型號： TMS32C5402PGER10G4
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號處理
英文描述： FIXED-POINT DIGITAL SIGNAL PROCESSOR
中文描述： 定點數(shù)字信號處理器
文件頁數(shù)： 43/68頁
文件大?。?/td> 948K
代理商： TMS32C5402PGER10G4
SPRS079E – OCTOBER 1998 – REVISED AUGUST 2000
43
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
memory and parallel I/O interface timing (continued)
timing requirements for a parallel I/O port read (IOSTRB = 0)[H = 0.5 t
c(CO)
]
(see Figure 15)
MIN
MAX
UNIT
ta(A)IO
ta(ISTRBL)IO
tsu(D)IOR
th(D)IOR
th(ISTRBH-D)R
Address and IS timings are included in timings referenced as address.
Access time, read data access from address valid
3H–7
ns
Access time, read data access from IOSTRB low
2H–7
ns
Setup time, read data before CLKOUT high
6
ns
Hold time, read data after CLKOUT high
0
ns
Hold time, read data after IOSTRB high
0
ns
switching characteristics over recommended operating conditions for a parallel I/O port read
(IOSTRB = 0)
(see Figure 15)
PARAMETER
MIN
MAX
UNIT
td(CLKL-A)
td(CLKH-ISTRBL)
td(CLKH-ISTRBH)
th(A)IOR
Address and IS timings are included in timings referenced as address.
Delay time, CLKOUT low to address valid
–2
3
ns
Delay time, CLKOUT high to IOSTRB low
–2
3
ns
Delay time, CLKOUT high to IOSTRB high
–2
3
ns
Hold time, address after CLKOUT low
0
3
ns
IS
R/W
IOSTRB
D[15:0]
A[19:0]
CLKOUT
th(A)IOR
td(CLKH-ISTRBH)
th(D)IOR
tsu(D)IOR
ta(A)IO
td(CLKH-ISTRBL)
td(CLKL-A)
ta(ISTRBL)IO
th(ISTRBH-D)R
NOTE A: A[19:16] are always driven low during accesses to I/O space.
Figure 15. Parallel I/O Port Read (IOSTRB = 0)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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TMS32C6203BGLS173A 制造商:Texas Instruments 功能描述:FIXED-POINT DIGITAL SIGNAL PROCESSOR - Trays
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