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參數(shù)資料
| 型號： | SYM53C1010-33 |
| 廠商： | LSI Corporation |
| 英文描述： | PCI to Dual Channel Ultra3 SCSI Multifunction Controller(PCI與雙通道Ultra3 SCSI連接的多功能控制器) |
| 中文描述： | PCI到雙通道個Ultra3 SCSI多功能控制器（與雙通道的PCI個Ultra3 SCSI連接的多功能控制器） |
| 文件頁數(shù)： | 76/384頁 |
| 文件大小： | 3924K |
| 代理商： | SYM53C1010-33 |
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2-48
Functional Description
indicating an interrupt. This method is the fastest, but it diverts CPU time
from other system tasks. The preferred method of detecting interrupts in
most systems is hardware interrupts. In this case, the SYM53C1010
asserts the interrupt request (INTA/ or INTB/) line that interrupts the
microprocessor, causing the microprocessor to execute an Interrupt
Service Routine (ISR). A hybrid approach would use hardware interrupts
for long waits and polling for short waits.
SCSI Function A is routed to PCI Interrupt INTA/. SCSI Function B is
normally routed to INTB/, but can be routed to INTA/ if a pull-up is
connected to MAD[4]. See
Section 3.8, “MAD Bus Programming”
for
additional information.
2.2.16.2 Registers
The registers in the SYM53C1010 used for detecting or defining
interrupts are
SCSI Interrupt Status Zero (SIST0)
,
SCSI Interrupt Status
One (SIST1)
,
DMA Status (DSTAT), SCSI Interrupt Enable Zero (SIEN0)
,
SCSI Interrupt Enable One (SIEN1)
, and
DMA Interrupt Enable (DIEN)
.
See the register descriptions in
Chapter 4, “Registers”
for additional
information.
ISTAT –
The ISTAT register includes the
Interrupt Status Zero (ISTAT0),
Interrupt Status One (ISTAT1)
,
Mailbox Zero (MBOX0)
, and
Mailbox One
(MBOX1)
registers. It is the only register that can be accessed as a slave
during the SCRIPTS operation. Therefore, it is the register that is polled
when polled interrupts are used. It is also the first register that should be
read after the INTA/ (or INTB/) pin is asserted in association with a
hardware interrupt.
The INTF (Interrupt-on-the-Fly) bit should be the first interrupt serviced.
It must be written to one in order to clear it. This interrupt must be
cleared before servicing any other interrupts indicated by SIP or DIP. Do
not attempt to read the other chip status registers if the INTF bit is set,
but SIP or DIP are not set.
If the SIP bit in the
Interrupt Status Zero (ISTAT0)
register is set, then a
SCSI-type interrupt has occurred and the
SCSI Interrupt Status Zero
(SIST0)
and
SCSI Interrupt Status One (SIST1)
registers should be read.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SYM53C1010R | PCI-Dual Channel Ultra160 SCSI Controller(PCI-雙通道Ultra160 SCSI控制器) |
| SYM53C1010 | PCI-Single Channel Ultra160 SCSI Controller(PCI-單通道Ultra160 SCSI控制器) |
| SYM53C120 | SCSI Bus Expander(SCSI總線擴(kuò)展器) |
| SYM53C140 | Ultra2 SCSI Bus Expander(Ultra2 SCSI總線擴(kuò)展器) |
| SYM53C141 | SCSI Bus Expander(SCSI總線擴(kuò)展器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| SYM53C400A | 制造商:SYMBIOS 功能描述: |
| SYM53C770 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
| SYM53C876E(PBGA) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
| SYM53C876E(PQFP) | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:SCSI Bus Interface/Controller |
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