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參數(shù)資料
| 型號(hào)： | STA450A |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | XMRADIO SDARS SERVICE LAYER & SOURCE DECODER |
| 中文描述： | XMRADIO衛(wèi)星數(shù)字收音機(jī)服務(wù)層 |
| 文件頁數(shù)： | 25/66頁 |
| 文件大?。?/td> | 439K |
| 代理商： | STA450A |
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STA450A
Invert_sclk
Bit 2
0: LRCLK and PCM_OUT sampled on the falling edge of the SCLK
1: LRCLK and PCM_OUT sampled on the raising edge of the SCLK
Format
Bit 3
0: the output is in I2S format.
1: the output is in SONY format.
Invert_lrclk
Bit 4
0: LRCLK = 0 (low) will select the left channel.
1: LRCLK = 1 (high) will select the left channel
Pcm_dif
Bit 5
0: data are in the last SCLK cycles of LRCLK (right aligned)
1: data are in the first SCLK cycles of LRCLK (left aligned)
Pcm_ord
Bit 6
0: the transmission is done LSB first.
1: the transmission is done MSB first.
Pcm_iec_chansel
Bit 7
0: no iec958 output.
1: iec958 output, data on I
2
S pin (PCSD) are no more valid.
HOST_APLL48_LSB
Address
Type
Software Reset
Hardware Reset
: 0x50
: R/W
: NA
: NA
HOST_APLL48_MSB
Address
Type
Software Reset
Hardware Reset
: 0x51
: R/W
: NA
: NA
Description
The HOST_APLL48_LSB and the HOST_APLL48_MSB are considered logically concatenated and
contain the fractional values for the Audio Fractional PLL for the Fs = 48KHz family.
The registers have to be programmed before the start_up of the DSP.
HOST_APLL48_XDIV
Address
: 0x52
7
6
5
4
3
2
1
0
50
7
6
5
4
3
2
1
0
51
7
6
5
4
3
2
1
0
52
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| STA508 | 40V 4.5A QUAD POWER HALF BRIDGE |
| STABP01 | GT 7C 7#16S SKT PLUG RTANG |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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