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參數(shù)資料
| 型號(hào)： | STA450A |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | XMRADIO SDARS SERVICE LAYER & SOURCE DECODER |
| 中文描述： | XMRADIO衛(wèi)星數(shù)字收音機(jī)服務(wù)層 |
| 文件頁(yè)數(shù)： | 20/66頁(yè) |
| 文件大?。?/td> | 439K |
| 代理商： | STA450A |
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STA450A
20/66
HOST_Cmd0
Address
Type
Software Reset
Hardware Reset
Description
A write into the bits 0 of this register generates a interrupt to the DSP core
: R/W
: 0
: 0
HOST_I2cdiv
Address
Type
Software Reset
Hardware Reset
Description
Hold time = HOST_I2cdiv/fc where the fc is the DSP system frequency.
: 0x1C
: R/W
: 0x0B
: 0x0B
HOST_SerialDivH - HOST_SerialDivL
Address
Type
Software Reset
Hardware Reset
: 0x1F - 0x1E
: R/W
: 0x00(HOST_SerialDivH) - 0x00 (HOST_SerialDivL)
: 0x00 (HOST_SerialDivH) - 0x00 (HOST_SerialDivL)
Description
These registers are used to specify the frequency division factor of the system clock for the RS232
interface used for the emulation; bit rate = fc/(( HOST_SerialDivH << 8) | HOST_SerialDivL)
HOST_MemoryAccess
Address
Type
Software Reset
Hardware Reset
: 0x2B
: W
: NA
: 0
Description
Setting the bit 3 the core is enabled to access the ucode inside the memory
7
6
5
4
3
2
1
0
13
Cmd0
7
6
5
4
3
2
1
0
1C
Div [5:0]
7
6
5
4
3
2
1
0
1F
Div [15:8]
1E
Div[7;0]
7
6
5
4
3
2
1
0
2B
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PDF描述 |
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