參數(shù)資料
型號: SAH-C515A-4R
廠商: INFINEON TECHNOLOGIES AG
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP80
封裝: METRIC, PLASTIC, QFP-80
文件頁數(shù): 119/182頁
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代理商: SAH-C515A-4R
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Semiconductor Group
4-7
1997-08-01
External Bus Interface
C515A
4.6.2 Protected ROM Mode
If the ROM is protected, the ROM verification mode 2 as shown in figure 4-4 is used to verify the
contents of the ROM. The detailed timing characteristics of the ROM verification mode is shown in
the AC specifications (chapter 10).
Figure 4-4
ROM Verification Mode 2
ROM verification mode 2 is selected if the inputs PSEN, EA, and ALE are put to the specified logic
levels. With RESET going inactive, the ROM verification mode 2 sequence is started. The C515A
outputs an ALE signal with a period of 12
tCLCL and expects data bytes at port 0. The data bytes at
port 0 are assigned to the ROM addresses in the following way :
1. Data Byte =
content of internal ROM address 0000H
2. Data Byte =
content of internal ROM address 0001H
3. Data Byte =
content of internal ROM address 0002H
:
16. Data Byte =
content of internal ROM address 000FH
:
The C515A-1R does not output any address information during the ROM verification mode 2. The
first data byte to be verified is always the byte which is assigned to the internal ROM address 0000H
and is put onto the data bus with the first rising edge of ALE. With each following ALE pulse the
ROM address pointer is internally incremented and the expected data byte for the next ROM
address must be delivered externally
Between two ALE pulses the data at port 0 is latched (at 3 CLP after ALE rising edge) and compared
internally with the ROM content of the actual address. If an verify error is detected, the error
MCT03222
Data for
Addr. 1
Low : Error
High : OK
~ ~
~~
~ ~
~ ~~
~
Latch
6
1. ALE Pulse
after Reset
~~
Inputs : ALE = SS
V
PSEN, EA =
V
IH
RESET =
RESET
ALE
Port 0
P3.5
Data for
Addr. X-16-1
Addr. X-16
Data for
Addr. x-16+1
Addr. 0
Data for
12
t
CLCL
t
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PDF描述
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參數(shù)描述
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