參數(shù)資料
型號： PNX1300
廠商： NXP Semiconductors N.V.
英文描述： Media Processors
中文描述： 媒體處理器
文件頁數(shù)： 92/548頁
文件大?。?/td> 6050K
代理商： PNX1300
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁當前第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁第280頁第281頁第282頁第283頁第284頁第285頁第286頁第287頁第288頁第289頁第290頁第291頁第292頁第293頁第294頁第295頁第296頁第297頁第298頁第299頁第300頁第301頁第302頁第303頁第304頁第305頁第306頁第307頁第308頁第309頁第310頁第311頁第312頁第313頁第314頁第315頁第316頁第317頁第318頁第319頁第320頁第321頁第322頁第323頁第324頁第325頁第326頁第327頁第328頁第329頁第330頁第331頁第332頁第333頁第334頁第335頁第336頁第337頁第338頁第339頁第340頁第341頁第342頁第343頁第344頁第345頁第346頁第347頁第348頁第349頁第350頁第351頁第352頁第353頁第354頁第355頁第356頁第357頁第358頁第359頁第360頁第361頁第362頁第363頁第364頁第365頁第366頁第367頁第368頁第369頁第370頁第371頁第372頁第373頁第374頁第375頁第376頁第377頁第378頁第379頁第380頁第381頁第382頁第383頁第384頁第385頁第386頁第387頁第388頁第389頁第390頁第391頁第392頁第393頁第394頁第395頁第396頁第397頁第398頁第399頁第400頁第401頁第402頁第403頁第404頁第405頁第406頁第407頁第408頁第409頁第410頁第411頁第412頁第413頁第414頁第415頁第416頁第417頁第418頁第419頁第420頁第421頁第422頁第423頁第424頁第425頁第426頁第427頁第428頁第429頁第430頁第431頁第432頁第433頁第434頁第435頁第436頁第437頁第438頁第439頁第440頁第441頁第442頁第443頁第444頁第445頁第446頁第447頁第448頁第449頁第450頁第451頁第452頁第453頁第454頁第455頁第456頁第457頁第458頁第459頁第460頁第461頁第462頁第463頁第464頁第465頁第466頁第467頁第468頁第469頁第470頁第471頁第472頁第473頁第474頁第475頁第476頁第477頁第478頁第479頁第480頁第481頁第482頁第483頁第484頁第485頁第486頁第487頁第488頁第489頁第490頁第491頁第492頁第493頁第494頁第495頁第496頁第497頁第498頁第499頁第500頁第501頁第502頁第503頁第504頁第505頁第506頁第507頁第508頁第509頁第510頁第511頁第512頁第513頁第514頁第515頁第516頁第517頁第518頁第519頁第520頁第521頁第522頁第523頁第524頁第525頁第526頁第527頁第528頁第529頁第530頁第531頁第532頁第533頁第534頁第535頁第536頁第537頁第538頁第539頁第540頁第541頁第542頁第543頁第544頁第545頁第546頁第547頁第548頁
PNX1300/01/02/11 Data Book
Philips Semiconductors
5-10
PRELIMINARY SPECIFICATION
Reading the LRU bits produces a 32-bit result with the
format shown at the bottom of
Figure 5-11
. The least-sig-
nificant ten bits contain the state of the LRU bits when the
ld32 was executed. See
Section 5.6.7,
“
LRU Bit Defini-
tions,
”
for a description of the LRU bits.
Note that the tag_i_mux and set fields in the address for-
mats of
Figure 5-10
are larger than necessary for the in-
struction cache in PNX1300. These fields will allow fu-
ture implementations with larger instruction caches to
use a compatible mechanism for reading instruction
cache information. The tag_i_mux field can accommo-
date a cache of up to 16-way set-associativity, and the
set field can accommodate a cache with up to 512 sets.
For PNX1300, the following constraints of the values of
these fields must be observed:
1. 0
≤
tag_i_mux
≤
7
2. 0
≤
set
≤
63
5.4.9
Cache Locking
Like the data cache, the instruction cache allows up to
one-half of its blocks to be locked. A locked block is nev-
er chosen as a victim by the replacement algorithm; its
contents remain undisturbed until the locked status is
changed explicitly by software. Thus, on PNX1300, up to
16 KB of the cache can be used as a high-speed instruc-
tion
‘
ROM.
’
Only four out of eight blocks in any set can be
locked.
The MMIO registers IC_LOCK_ADDR, IC_LOCK_SIZE,
and IC_LOCK_CTL
—
shown in
Figure 5-12
—
are used to
define and enable instruction locking in the same way
that the similarly named data-cache locking registers are
used.
Section 5.3.7,
“
Cache Locking,
”
describes the de-
tails of cache locking; they are not repeated here.
Setting the IC_LOCK_ENABLE bit (in IC_LOCK_CTL) to
‘
1
’
causes the following sequence of events:
1. The instruction cache invalidates all blocks in the
cache.
2. The instruction cache fetches all blocks in the lock
range (defined by IC_LOCK_ADDR and
IC_LOCK_SIZE) from main memory into the cache.
3. Cache locking is activated so that the locked blocks
cannot be victims of the replacement algorithm.
The only difference between this sequence and the ini-
tialization sequence for data-cache locking is that dirty
blocks (which cannot exist in the instruction cache) are
not written back first.
Programmer’s note:
Programmers (or compilers) must
combine all instructions that need to be locked into the
single linear instruction-locking address range.
The special iclr operation also removes locked blocks
from the cache. If blocks are locked in the instruction
cache, then instruction cache locking should be disabled
in software (by writing
‘
0
’
to IC_LOCK_CTL) before an
iclr operation is issued.
Locking should not be enabled by PCI accesses to the
MMIO register.
5.4.10
Instruction Cache Initialization and
Boot Sequence
When PNX1300 is reset, the instruction cache executes
an initialization and processor boot sequence. While re-
set is asserted, the instruction cache forces NOP opera-
tion to the DSPCPU, and the program counter is set to
the default value reset_vector. When reset is deassert-
ed, the initialization and boot sequence is as follows.
31
0
3
7
11
15
0
19
23
27
To Read Tag & Valid Bit
To Read LRU Bits
SET
MMIO_BASE
1 0 0 0 0
MMIO_BASE
TAG_I_MUX
SET
0 0
0 0
Figure 5-10. Required address format for reading instruction-cache tags and status.
31
0 0 0 0 0 0 0 0 0 0
0
3
7
11
15
19
23
27
VALID
I-Cache Tag-Read Result Format
I-Cache Status-Read Result Format
LRU
0 0 0 0 0 0 0 0 0 0 0
0 0 0
0
0 0 0 0 0 0 0 0
TAG
Figure 5-11. Result formats for reads from the instruction-cache region of the MMIO aperture.
IC_LOCK_ADDR (r/w)
0x10 0214
IC_LOCK_ADDRESS
IC_LOCK_SIZE (r/w)
0x10 0218
IC_LOCK_SIZE
0 0 0 0 0 0
0 0 0 0 0 0
31
0 0 0 0 0 0
0
3
7
11
0 0 0 0 0 0
15
19
23
0 0 0 0 0 0
27
IC_LOCK_CTL (r/w)
0x10 0210
0
0 0 0 0 0 0
0 0
IC_LOCK_ENABLE
MMIO_BASE
offset:
0 0 0 0 0 0
0 0
0
0 0
0 0 0 0 0 0
0 0
0 0 0 0 0 0
0 0
reserved
Figure 5-12. Formats of the registers that control instruction-cache locking.
相關(guān)PDF資料
PDF描述
PNX1301 Media Processors
PNX1302 Media Processors
PNX1311 Media Processors
PNX1500G Connected Media Processor
PNX1501G Connected Media Processor
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
PNX1300EH,557 功能描述:視頻 IC NEXPERIA MEDIA PROCESSOR RoHS:否 制造商:Fairchild Semiconductor 工作電源電壓:5 V 電源電流:80 mA 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-28 封裝:Reel
PNX1300EH/G,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 143MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1301 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1301EH 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1301EH,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
發(fā)布緊急采購，3分鐘左右您將得到回復。

采購需求

(若只采購一條型號，填寫一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

發(fā)布成功！您可以繼續(xù)發(fā)布采購。也可以進入我的后臺，查看報價

*型號 *數(shù)量 廠商 批號 封裝
添加更多采購

我的聯(lián)系方式

*
*
*