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參數(shù)資料
| 型號： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 92/120頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | MCIMX507CVM8B |
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Electrical Characteristics
i.MX50 Applications Processors for Consumer Products, Rev. 0
Freescale Semiconductor
73
4.9.2.3
eCSPI Master Mode Timing
Figure 34 depicts the timing of eCSPI in master mode and Table 49 lists the eCSPI master mode timing
characteristics.
Figure 34. eCSPI Master Mode Timing Diagram
Table 49. eCSPI Master Mode Timing Parameters
ID
Parameter
Symbol
Min
Max
Unit
CS1
eCSPIx_CLK Cycle Time–Read
eCSPIx_CLK Cycle Time–Write
tclk
60
15
—ns
CS2
eCSPIx_CLK High or Low Time
tSW
6—
ns
CS3
eCSPIx_CLK Rise or Fall
tRISE/FALL
——
ns
CS4
eCSPIx_CS_x pulse width
tCSLH
15
—
ns
CS5
eCSPIx_CS_x Lead Time (CS setup time)
tSCS
5—
ns
CS6
eCSPIx_CS_x Lag Time (CS hold time)
tHCS
5—
ns
CS7
eCSPIx_DO Setup Time
tSmosi
5—
ns
CS8
eCSPIx_DO Hold Time
tHmosi
5—
ns
CS9
eCSPIx_DI Setup Time
tSmiso
5—
ns
CS10
eCSPIx_DI Hold Time
tHmiso
5—
ns
CS11
eCSPIx_DRYN Setup Time
tSDRY
5—
ns
CS1
CS7 CS8
CS2
CS4
CS6
CS5
CS9 CS10
eCSPIx_CLK
eCSPIx_CS_x
eCSPIx_DO
eCSPIx_DI
eCSPIx_DRYN1
CS11
CS3
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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