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參數(shù)資料
| 型號： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 74/120頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | MCIMX507CVM8B |
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Electrical Characteristics
i.MX50 Applications Processors for Consumer Products, Rev. 0
Freescale Semiconductor
57
4.7
External Interface Module (EIM)
The following sections provide information on the EIM.
4.7.1
General EIM Timing
Figure 17, Figure 18, and Table 40 specify the timings related to the EIM module. All EIM output control
signals may be asserted and de-asserted by an internal clock synchronized to the EIM_BCLK rising edge
according to corresponding assertion/negation control fields.
,
Figure 17. EIM Outputs Timing Diagram
NF23
preamble delay
tPRE
(PRE_DELAY+1)*tCK
—
ns
NF24
postamble delay
tPOST
POST_DELAY*tCK
—
ns
NF25
CLE and ALE setup time
tCALS
0.5*tCK
—
ns
NF26
CLE and ALE hold time
tCALH
0.5*tCK
—
ns
1 GPMI’s sync mode output timing could be controlled by module’s internal register, say HW_GPMI_TIMING2_CE_DELAY,
HW_GPMI_TIMING_PREAMBLE_DELAY, HW_GPMI_TIMING2_POST_DELAY. This AC timing depends on these registers’
setting. In the above table, we use CE_DELAY/PRE_DELAY/POST_DELAY representing these settings each.
Table 39. Samsung Toggle Mode Timing Parameters1 (continued)
ID
Parameter
Symbol
Timing
T = GPMI Clock Cycle
Unit
Min.
Max.
WE4
EIM_ADDR
EIM_CSx
EIM_RW
EIM_OE
EIM_BCLK
EIM_EBx
EIM_LBA
EIM_DATA
...
WE5
WE6
WE7
WE8
WE9
WE10
WE11
WE12
WE13
WE14
WE15
WE16
WE17
WE3
WE2
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