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參數(shù)資料
| 型號(hào)： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 61/120頁 |
| 文件大小： | 1980K |
| 代理商： | MCIMX507CVM8B |
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Electrical Characteristics
i.MX50 Applications Processors for Consumer Products, Rev. 0
Freescale Semiconductor
45
4.6
System Modules Timing
This section contains the timing and electrical parameters for the modules in the i.MX50 processor.
4.6.1
Reset Timings Parameters
Figure 6. Reset Timing Diagram
4.6.2
WDOG Reset Timing Parameters
Figure 7. WDOG_RST_B Timing Diagram
Single output slew rate
(Driver impedance =40
Ω+/-30%)
tsr
1.5
3.5
V/ns
Single output slew rate
(Driver impedance =60
Ω+/-30%
tsr
1
2.5
V/ns
1Vid(ac) specifies the input differential voltage |Vtr-Vcp| required for switching, where Vtr is the
“true” input signal and Vcp is the “complementary” input signal. The Minimum value is equal to
Vih(ac)-Vil(ac).
2The typical value of Vix(ac) is expected to be about 0.5*OVDD. and Vix(ac) is expected to track
variation of OVDD. Vix(ac) indicates the voltage at which differential input signal must cross.
Table 33. Reset Timing Parameters
ID
Parameter
Min
Max
Unit
CC1
Duration of RESET_IN_B assertion to be qualified as valid (input slope =
5ns)
50
—
ns
Table 32. LPDDR2 I/O AC Parameters (continued)
Parameter
Symbol
Min
Max
Unit
RESET_IN_B
CC1
(Input)
WDOG_RST_B
CC5
(Input)
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