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參數(shù)資料
| 型號： | MCIMX507CVM8B |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA400 |
| 封裝： | 17 X 17 MM, 0.5 MM PITCH, ROHS COMPLIANT, PLASTIC, MABGA-400 |
| 文件頁數(shù)： | 62/120頁 |
| 文件大?。?/td> | 1980K |
| 代理商： | MCIMX507CVM8B |
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i.MX50 Applications Processors for Consumer Products, Rev. 0
46
Freescale Semiconductor
Electrical Characteristics
NOTE
CKIL is approximately 32 kHz. TCKIL is one period or approximately
30
μs.
4.6.3
Clock Amplifier Parameters (CKIH)
The input to clock amplifier (CAMP) is internally ac-coupled allowing direct interface to a square wave or
sinusoidal frequency source. No external series capacitors are required.
Table 35 shows the electrical parameters of CAMP.
4.6.4
DPLL Electrical Parameters
Table 36 shows the electrical parameters of digital phase-locked loop (DPLL).
Table 34. WDOG_RST_B Timing Parameters
ID
Parameter
Min
Max
Unit
CC5
Duration of WDOG_RST_B Assertion
1
—
TCKIL
Table 35. CAMP Electrical Parameters (CKIH)
Parameter
Min
Typ
Max
Unit
Input frequency
8.0
—
40.0
MHz
VIL (for square wave input)
0
—
0.3
V
VIH (for square wave input)
(VCC1 –0.25)
1 VCC is the supply voltage of CAMP.
—3
V
Sinusoidal input amplitude
0.4 2
2 This value of the sinusoidal input is determined during characterization.
—VDD
Vp-p
Output duty cycle
45
50
55
%
Table 36. DPLL Electrical Parameters
Parameter
Test Conditions/Remarks
Min
Typ
Max
Unit
Reference clock frequency range1
—10
—
100
MHz
Reference clock frequency range after
pre-divider
—10
—
40
MHz
Output clock frequency range (dpdck_2)
—
300
—
1025
MHz
Pre-division factor2
—1
—
16
—
Multiplication factor integer part
—
5
—
15
—
Multiplication factor numerator3
Should be less than denominator
–67108862
—
67108862
—
Multiplication factor denominator2
—
1
—
67108863
—
Output duty cycle
—
48.5
50
51.5
%
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