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參數(shù)資料
| 型號： | MC68HC916X1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 16-Bit Modular Microcontroller(16位模塊化微控制器) |
| 中文描述： | 16位微控制器模塊（16位模塊化微控制器） |
| 文件頁數(shù)： | 104/172頁 |
| 文件大?。?/td> | 1035K |
| 代理商： | MC68HC916X1 |
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MOTOROLA
104
MC68HC916X1
MC68HC916X1TS/D
PORTQS latches I/O data. Writes drive pins defined as outputs. Reads return data present on the
pins. To avoid driving undefined data, first write a byte to PORTQS, then configure DDRQS.
Clearing a bit in PQSPAR assigns the corresponding pin to general-purpose I/O; setting a bit as-
signs the pin to the QSPI. PQSPAR does not affect operation of the SCI.
Table 55
displays PQS-
PAR pin assignments.
DDRQS determines whether pins are inputs or outputs. Clearing a bit makes the corresponding pin
an input; setting a bit makes the pin an output. DDRQS affects both QSPI function and I/O function.
Table 56
shows the effect of DDRQS on QSM pin functions.
1. PQS2 is a digital I/O pin unless the SPI is en-
abled (SPE in SPCR1 set), in which case it be-
comes SPI serial clock SCK.
2. PQS7 is a digital I/O pin unless the SCI trans-
mitter is enabled (TE in SCCR1 = 1), in which
case it becomes SCI serial output TXD.
PORTQS
— Port QS Data Register
$YFFC14
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
PQS7
PQS6
PQS5
PQS4
PQS3
PQS2
PQS1
PQS0
RESET:
0
0
0
0
0
0
0
0
PQSPAR
— PORT QS Pin Assignment Register
DDRQS
— PORT QS Data Direction Register
$YFFC16
$YFFC17
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
0
PQSPA6 PQSPA5 PQSPA4 PQSPA3
0
PQSPA1 PQSPA0 DDQS7 DDQS6 DDQS5 DDQS4 DDQS3 DDQS2 DDQS1 DDQS0
RESET:
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
Table 55 PQSPAR Pin Assignments
PQSPAR Field
PQSPA0
PQSPAR Bit
0
1
0
1
—
—
0
1
0
1
0
1
0
1
—
—
Pin Function
PQS0
MISO
PQS1
MOSI
PQS2
1
SCK
PQS3
PCS0/SS
PQS4
PCS1
PQS5
PCS2
PQS6
PCS3
PQS7
2
TXD
PQSPA1
—
PQSPA3
PQSPA4
PQSPA5
PQSPA6
—
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PDF描述 |
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