參數(shù)資料
型號(hào)： FDC37B787QF
廠商： SMSC Corporation
英文描述： Super I/O Controller with ACPI Support, Real Time Clock and Consumer IR
中文描述： 超級(jí)I / O與ACPI支持控制器，實(shí)時(shí)時(shí)鐘和消費(fèi)性紅外
文件頁數(shù)： 147/249頁
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代理商： FDC37B787QF
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FIGURE 3 - SOFT POWER MANAGEMENT FUNCTIONAL DIAGRAM
Note 1: All soft power management functions run off of VTR. When VTR is present, it supplies power to
the RTC. When VTR is not present, Vbat supplies power to the RTC and Flip Flop 1.
Note 2: Flip Flop 1 is battery backed-up so that it returns the last valid state of the machine.
Note 3: A battery backed-up enable bit in the alarm control register can be set to force Flip Flop 1 in the
soft power management circuit to come up ‘on’ if an alarm occurred when VTR was not
present. This is gated into wakeup circuitry. Refer to the AL_REM_EN Bit description in the
RTC Control Register section for more information.
Note 4: A battery backed-up enable bit in the alarm control register can be set to force Flip Flop 1 to
come up ‘off’ after a VTR POR, see VTR_POR_OFF.
A transition on the Button input, or on any enabled
A low pulse on the Soft Power Off signal, a Vbat POR, a VTR POR with Vbat<1.2V, or Power Button Override Event causes
nPowerOn to float.
ED;PG = Edge Detect, Pulse Generator
ED;L = Edge Detect and Latch
inputs causes the nPowerOn output to go active low.
SPx
EN1
ENx
Q
CLR
Button Input
SP1
SPx
Open Collector
Type Output
Soft Power
Off
nSPOFF1
nPowerOn
VTR
nSPOFF1
ED; PG
ED; L
ED; L
Alarm
OFF_EN
OFF_DLY
nSPOFF1
nSPOFF
Delay1
OFF_DLY
Delay2
nBINT
Logic
L
Button
V
BAT
POR
AL_REM_EN
Flip
D
VTR POR
VTR_POR_EN
Logic
Logic
Override
Timer
PWRBTNOR_STS
PWRBTNOR_EN
nSPOFF1
V
TR
POR With
Vbat<1.2V
V
TR_
POR_OFF
VTR POR
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PDF描述
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