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參數(shù)資料
| 型號(hào)： | CN8223EPF |
| 英文描述： | ATM/SONET TRANSCEIVER|CMOS|QFP|160PIN|PLASTIC |
| 中文描述： | 的ATM / SONET的收發(fā)器|的CMOS | QFP封裝| 160PIN |塑料 |
| 文件頁數(shù)： | 37/161頁 |
| 文件大?。?/td> | 1865K |
| 代理商： | CN8223EPF |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁當(dāng)前第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁
0
CN8223
2.0 Functional Description
ATM Transmitter/Receiver with UTOPIA Interface
2.2 Line Framers
100046D
Conexant
2-3
2.2 Line Framers
This section describes the operation and control of the internal framers for DS3,
E3 (both G.751 and G.832), E4 (G.832), STS-1, and STS-3c/STM-1 formatted
serial streams. The transmit and receive serial interfaces can operate at up to
155 MHz. Detailed timing information for the line interface is given in
Chapter 4.0
.
The framer receive circuitry recovers the frame location from the serial stream
and provides cell octets to the HEC/PLCP cell alignment block. All alarm and
error conditions are monitored and reported in status registers and event counters.
The framer transmit circuitry receives cell octets from the HEC/PLCP cell
alignment block and adds line framing overhead information. All alarm and error
conditions can be generated from control registers.
External interfaces to this block and the interface to the rest of the CN8223 are
illustrated in
Table 1-2
. The CN8223 line mode is set for both transmit and
receive in the CONFIG_1 register [0x00].
Table 2-1
lists the valid line modes set
by CONFIG_1.
Table 2-1. Valid CONFIG_1 Line Mode Settings, Bits 7–0
Type of Line Input Signal
PHY
Type
Unframed
Input
Disable
B3ZS/
HDB3
External
Framer
Enable
Parallel
Interface
Enable
HEC
Align
DS1
0
0
0
1
0
0 or 1
DS1 (externally gapped 192 bits/frame)
1
0
1
0
0
E1
1
0
0
1
0
0 or 1
E1 (externally gapped TS0 and TS16)
1
1
0
1
0
0
DS3, internal framer
2
0
0 or 1
0
0
0 or 1
DS3, external framer
2
0
0
1
0
0 or 1
DS3, external framer (gapped 84/85 bits)
2
1
0
1
0
0
E3, internal G.751 format
3
0
0 or 1
0
0
0
E3, external G.751 format
3
0
0
1
0
0
E3, external G.751 format (gapped first 16
bits)
3
1
0
1
0
0
E3, internal G.832 format
4
x
0 or 1
0
0
1
E4, internal G.832 format
5
x
1
0
0
1
STS-1, internal framer
6
x
0 or 1
0
0
1
STS-3c/STM-1, internal framer
7
x
1
0
0
1
Parallel or TAXI interface, 53 octet cells
0
x
0
1
1
1
NOTE(S):
x = Don
’
t Care.
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