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參數(shù)資料
| 型號(hào)： | AM79C850KCW |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SUPERNET-R 3 |
| 中文描述： | 1 CHANNEL(S), 100M bps, FDDI CONTROLLER, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁(yè)數(shù)： | 27/97頁(yè) |
| 文件大?。?/td> | 358K |
| 代理商： | AM79C850KCW |
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P R E L I M I N A R Y
AMD
27
SUPERNET 3
LSB
MSB
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
19574A-3
MENRS
MENXS
MENXCT
MENAFULL
MEIND0
MEIND1
MENQCTRL
MENRQAUNLCK
MENDAS
MENPLCCST
MENSGLINT
MENDRCV
MENFCLOC0
MENFCLOC1
MENTRCMD
MENTDLPBK
Figure 2. Register 3 (MDREG3) (NPADDR = 60h)
MENRS (bit 0)
Enable enhanced Receive status encoding.
MENXS (bit 1)
Enable enhanced Transmit status encoding.
MENXCT (bit 2)
Enable EXACT/INEXACT matching.
MENAFULL (bit 3)
Enable enhanced QCTRL encoding for AFULL.
MEIND0, MEIND1 (bits 4, 5)
Enables enhanced A, C indicator setting.
MENQCTRL (bit 6)
Enables enhanced QCTRL encoding.
MENRQAUNLCK (bit 7)
Enable Receive Queue Auto Unlock.
MENDAS (bit 8)*
Enables DAS connections by controlling the MUX.
MENPLCCST (bit 9)
Enables Counter Segmentation Test in PLC block
MENSGLINT (bit 10)
Enables Vectored Interrupt reading. The MINTR4 is used as the Vectored Interrupt.
MENDRCV (bit 11)
Enables dual receive queue operation.
MENFCLOC (bit12,13)
Enables the FC location within the frame data long word.
MENTRCMD (bit 14)
Enables the ASYNC1 queue to transmit only after the command is issued.
MENTDLPBK (bit 15)
Enable TDAT to RDAT loopback
* This bit should only be set if the external PHY is available for a DAS configuration.
Bit
Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
|---|---|
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| AM79C864AKC | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Physical Layer Controller With Scrambler (PLC-S) |
| AM79C864AKCW | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Physical Layer Controller With Scrambler (PLC-S) |
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| AM79C870KC/W | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LAN Transceiver |
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