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參數(shù)資料
| 型號(hào)： | ADV7321KSTZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 3/88頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC VID ENC 6-12BIT DAC'S 64LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 視頻編碼器 |
| 應(yīng)用： | EVD，DVD，SD/PS/HDTV |
| 電壓 - 電源，模擬： | 2.5V |
| 電壓 - 電源，數(shù)字： | 2.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-LQFP（10x10） |
| 包裝： | 托盤 |
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ADV7320/ADV7321
Rev. A | Page 11 of 88
t9
t11
t10
t12
t14
t13
CLKIN_A
Y9–Y0
t9 = CLOCK HIGH TIME
t10 = CLOCK LOW TIME
t11 = DATA SETUP TIME
t12 = DATA HOLD TIME
t13 = HD OUTPUT ACCESS TIME
t14 = HD OUTPUT HOLD TIME
CONTROL
INPUTS
CONTROL
OUTPUTS
Yxxx
Crxxx
Y1
Cr0
Y0
Cb0
P_VSYNC,
P_HSYNC,
P_BLANK
05067-007
Figure 7. PS 4:2:2 10-Bit Interleaved at 54 MHz HSYNC /VSYNC Input Mode (Input Mode 111)
t9
t11
t10
t12
t11
t12
t13
t14
CLKIN_B*
*CLKIN_B USED IN THIS PS ONLY MODE.
Y9–Y0
t9 = CLOCK HIGH TIME
t10 = CLOCK LOW TIME
t11 = DATA SETUP TIME
t12 = DATA HOLD TIME
t13 = HD OUTPUT ACCESS TIME
t14 = HD OUTPUT HOLD TIME
CONTROL
OUTPUTS
Y1
Cr0
Y0
Cb0
XY
00
3FF
05067-008
Figure 8. PS Only 4:2:2 10-Bit Interleaved at 27 MHz EAV/SAV Input Mode (Input Mode 100)
t9
t11
t10
t12
t14
t13
CLKIN_A
Y9–Y0
t9 = CLOCK HIGH TIME
t10 = CLOCK LOW TIME
t11 = DATA SETUP TIME
t12 = DATA HOLD TIME
t13 = HD OUTPUT ACCESS TIME
t14 = HD OUTPUT HOLD TIME
CONTROL
OUTPUTS
NOTES
1. Y0, Cb0 SEQUENCE AS PER SUBADDRESS 0x01 BIT 1.
3FF
00
XY
Cb0
Y0
Cr0
Y1
05067-009
Figure 9. PS Only 4:2:2 10-Bit Interleaved at 54 MHz EAV/SAV Input Mode (Input Mode 111)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| ADV73225710 | 制造商:LG Corporation 功能描述:Frame Assembly |
| ADV73225718 | 制造商:LG Corporation 功能描述:Frame Assembly |
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