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參數(shù)資料
| 型號： | 935277748557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 封裝： | 27 X 27 MM, 1.75 MM HIEGHT, LEAD FREE, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 448/828頁 |
| 文件大?。?/td> | 7748K |
| 代理商： | 935277748557 |
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 14: FGPI: Fast General Purpose Interface
PNX15XX_SER_3
Koninklijke Philips Electronics N.V. 2006. All rights reserved.
Product data sheet
Rev. 3 — 17 March 2006
14-18
4.
Register Descriptions
4.1 Mode Registers
Table 2: Register Summary
Offset
Name
Clock
Domain
Description
0x07,0000
FGPI_CTL
fgpi
Controls operational mode and enables/disables DMA transfers
0x07,0004
FGPI_BASE1
mmio
Starting address for rst buffer
0x07,0008
FGPI_BASE2
mmio
Starting address for second buffer
0x07,000C
FGPI_SIZE
fgpi
Number of records/messages per buffer
0x07,0010
FGPI_REC_SIZE
fgpi
Size of record/message in samples
0x07,0014
FGPI_STRIDE
fgpi
Address stride between records/messages
0x07,0018
FGPI_NREC1
mmio
Number of records/messages transferred into buffer 1
0x07,001C
FGPI_NREC2
mmio
Number of records/messages transferred into buffer 2
0x07,0020
FGPI_THRESH1
fgpi
Interrupt Threshold for Buffer 1
0x07,0024
FGPI_THRESH2
fgpi
Interrupt Threshold for Buffer 2
0x07,0028 -
0x07,0FDC
reserved
n/a
0x07,0FE0
FGPI_IR_STATUS
mmio
Module Interrupt Status
0x07,0FE4
FGPI_IR_ENA
mmio
Module Interrupt Enables
0x07,0FE8
FGPI_IR_CLR
mmio
Module Interrupt Clear (Interrupt Acknowledge)
0x07,0FEC
FGPI_IR_SET
mmio
Module Interrupt Set (Debug)
0x07,0FF0
FGPI_SOFT_RST
mmio
Module Software Reset
0x07,0FF4
FGPI_IF_DIS
mmio
Module Interface Disable
0x07,0FF8
FGPI_MOD_ID_EXT
mmio
Module ID Extension
0x07,0FFC
FGPI_MOD_ID
mmio
Module ID
Table 3: Fast general purpose INput (FGPI)
Bit
Symbol
Acces
s
Value
Description
FPGI Registers
Offset 0x07,0000
FGPI_CTL
31:15
Reserved
R
0
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
14
POLARITY_CLK
R/W
0
Externally selects active clock edge for clk_fgpi via fgpi_clk_pol
0 = rising edge
1 = falling edge
Note: This bit not used in the PNX15xx Series. All FGPI clock
control is in the clock module.
13
CAPTURE_ENABLE_2
R/W
0
Enable input capture into buffer 2. This bit, along with bit 12 below,
start and stop FGPI DMA activity.
相關PDF資料 |
PDF描述 |
|---|---|
| 9353-2523-002 | PANEL MOUNT, CABLE TERMINATED, FEMALE, SMA CONNECTOR, CRIMP, JACK |
| 93568-151100 | INTERCONNECTION DEVICE |
| 93575-090001 | INTERCONNECTION DEVICE |
| 93578-090180 | INTERCONNECTION DEVICE |
| 93584-090001 | INTERCONNECTION DEVICE |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| 935277864112 | 制造商:NXP Semiconductors 功能描述:IC CPU |
| 935278818112 | 制造商:NXP Semiconductors 功能描述:LCD DRVR 20DIGIT 2.5V/3.3V/5V 56-Pin VSO Tube |
| 935280517132 | 制造商:NXP Semiconductors 功能描述:IC TRANSLATING BUFFER 6XSON |
| 935281751112 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
| 935281751118 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
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