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參數(shù)資料
| 型號(hào)： | 935277748557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 封裝： | 27 X 27 MM, 1.75 MM HIEGHT, LEAD FREE, PLASTIC, MS-034, BGA-456 |
| 文件頁(yè)數(shù)： | 381/828頁(yè) |
| 文件大?。?/td> | 7748K |
| 代理商： | 935277748557 |
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 12: Video Input Processor
PNX15XX_SER_3
Koninklijke Philips Electronics N.V. 2006. All rights reserved.
Product data sheet
Rev. 3 — 17 March 2006
12-14
Capture Enable Mode
Using the
cfen bits, video capture can be limited to odd or even or both elds. If both
elds are to be captured, the capture starts with the next odd eld.
The status of the osm (one-shot) bit in the mode-control-register species the capture
mode (one-shot or continuous):
If osm=0, the corresponding incoming video stream is captured continuously. For
example, in a video conference application the vanity image would be a
continuous stream to the frame buffer.
If osm=1, the corresponding incoming video stream is captured one eld or frame
at a time (depending on the
cfen bits).
Programming hint: In a video conference application the captured image would be a
one-shot stream to the host memory. If you write osm=1 and select eld/frame in the
register, it is captured on the next VSYNC and cfen bits are cleared to 0. To capture
the next image, the cfen and osm bits must be reprogrammed.
Address Generation
The line address is generated by loading the base address from the corresponding
register set at the beginning of each eld and adding the line pitch to it at the
beginning of every new line.The lower three bits of the rst three base address
registers are used as an intra-long-word offset for the left-most pixel components of
each line. The offset has to be a multiple of the number of bytes per component.
Double Buffer Mode
To avoid line tear caused by trying to display a frame at the same time that it is being
updated, a double buffer mode is available. In this double buffer mode, a second set
of DMA base addresses is available. After capturing and storing one complete frame
in the location described by one set, the other set is used for the next frame. The idea
is illustrated in Figure 11.
Figure 11: Double Buffer Mode
Frame 1
Frame 2
dma_base1
dma_base2
Odd
Even
Odd
Even
dma_base3
dma_base4
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 9353-2523-002 | PANEL MOUNT, CABLE TERMINATED, FEMALE, SMA CONNECTOR, CRIMP, JACK |
| 93568-151100 | INTERCONNECTION DEVICE |
| 93575-090001 | INTERCONNECTION DEVICE |
| 93578-090180 | INTERCONNECTION DEVICE |
| 93584-090001 | INTERCONNECTION DEVICE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935277864112 | 制造商:NXP Semiconductors 功能描述:IC CPU |
| 935278818112 | 制造商:NXP Semiconductors 功能描述:LCD DRVR 20DIGIT 2.5V/3.3V/5V 56-Pin VSO Tube |
| 935280517132 | 制造商:NXP Semiconductors 功能描述:IC TRANSLATING BUFFER 6XSON |
| 935281751112 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
| 935281751118 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
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