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參數(shù)資料
| 型號： | 935277747557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 封裝： | 27 X 27 MM, 1.75 MM HIEGHT, LEAD FREE, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 419/828頁 |
| 文件大?。?/td> | 7748K |
| 代理商： | 935277747557 |
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 13: FGPO: Fast General Purpose Output
PNX15XX_SER_3
Koninklijke Philips Electronics N.V. 2006. All rights reserved.
Product data sheet
Rev. 3 — 17 March 2006
13-15
4.
Register Descriptions
4.1 Mode Register Setup
Table 2: Register Summary
Offset
Name
Clock
Domain
Description
0x07,1000
FGPO_CTL
fgpo
Controls operational mode and enables/disables DMA transfers
0x07,1004
FGPO_BASE1
mmio
Starting address for rst buffer
0x07,1008
FGPO_BASE2
mmio
Starting address for second buffer
0x07,100C
FGPO_SIZE
fgpo
Number of records/messages per buffer
0x07,1010
FGPO_REC_SIZE
fgpo
Size of record/message in samples
0x07,1014
FGPO_STRIDE
fgpo
Address stride between records/messages
0x07,1018
FGPO_NREC1
mmio
Number of records/messages transferred from buffer 1
0x07,101C
FGPO_NREC2
mmio
Number of records/messages transferred from buffer 2
0x07,1020
FGPO_THRESH1
fgpo
Interrupt Threshold for Buffer 1
0x07,1024
FGPO_THRESH2
fgpo
Interrupt Threshold for Buffer 2
0x07,1028
FGPO_REC_GAP
fgpo
Delay between records/messages
0x07,102C
FGPO_BUF_GAP
fgpo
Delay between buffers
0x07,1030
FGPO_TIME1
fgpo
Timestamp when buffer 1 was nished
0x07,1034
FGPO_TIME2
fgpo
Timestamp when buffer 2 was nished
0x07,1038 -
0x07,1FDC
reserved
n/a
0x07,1FE0
FGPO_IR_STATUS
mmio
Module Interrupt Status
0x07,1FE4
FGPO_IR_ENA
mmio
Module Interrupt Enables
0x07,1FE8
FGPO_IR_CLR
mmio
Module Interrupt Clear (Interrupt Acknowledge)
0x07,1FEC
FGPO_IR_SET
mmio
Module Interrupt Set (Debug)
0x07,1FF0
FGPO_SOFT_RST
mmio
Module Software Reset
0x07,1FF4
FGPO_IF_DIS
mmio
Module Interface Disable
0x07,1FF8
FGPO_MOD_ID_EX
T
mmio
Module ID Extension
0x07,1FFC
FGPO_MOD_ID
mmio
Module ID
Table 3: Fast general purpose output (FGPO)
Bit
Symbol
Acces
s
Value
Description
FPGO Registers
Offset 0x07,1000
FGPO_CTL
31:22
Reserved
R
0
To ensure software backward compatibility unused or reserved bits
must be written as zeros and ignored upon read.
21
POLARITY_IN
R/W
0
Determines clk_fgpo clock sampling edge for fgpo_rec_sync and
fgpo_buf_sync inputs:
0 = use same active edge as for outputs
1 = use alternate active edge as for outputs
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 935272905557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935274744557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935277746557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935277748557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 9353-2523-002 | PANEL MOUNT, CABLE TERMINATED, FEMALE, SMA CONNECTOR, CRIMP, JACK |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 935277864112 | 制造商:NXP Semiconductors 功能描述:IC CPU |
| 935278818112 | 制造商:NXP Semiconductors 功能描述:LCD DRVR 20DIGIT 2.5V/3.3V/5V 56-Pin VSO Tube |
| 935280517132 | 制造商:NXP Semiconductors 功能描述:IC TRANSLATING BUFFER 6XSON |
| 935281751112 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
| 935281751118 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
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