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參數(shù)資料
| 型號： | XRT94L43IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 94/328頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER SONET/SDH OC12 516BGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 2.5V, 3.3V |
| 封裝/外殼： | 516-BBGA |
| 供應(yīng)商設(shè)備封裝： | 516-PBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L43
177
SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
REV. 1.0.2
B22
STS3TxA_DP_0
TxDS3FP_4
TxSTS1PL_4
I/O
TTL/
CMOS
STS-3/STM-1 Transmit Telecom Bus - Parity Input Pin - Channel
0; DS3/E3 Frame Generator Framing Pulse Input/Output Pin -
Channel 4:
The function of this pin depends upon whether or not theSTS-3/STM-
1 Telecom Bus Interface for Channel 0 has been enabled.
If STS-3/STM-1 Telecom Bus (Channel 0) has been enabled -
STS-3/STM-1 Transmit Telecom Bus - Parity Input Pin:
This input pin can be configured to function as one of the following.
1. The EVEN or ODD parity value of the bits which are input via the
ST3TXA_D_0[7:0] input pins.
2. The EVEN or ODD parity value of the bits which are being input
via the STS3TXA_D_0[7:0] input and the states of the
STS3TXA_PL_0 and STS3TXA_C1J1_0 input pins.
NOTE: Any one of these configuration selections can be made by
writing the appropriate value into the Interface Control
Register - Byte 0 register (Indirect Address = 0x00, 0x3B),
(Direct Address = 0x013B).
If STS-3/STM-1 Telecom Bus (Channel 0) is disabled -
TxDS3FP_4 (Transmit DS3 Frame Pulse Input/Output - Channel
4):
If the STS-3/STM-1 Telecom Bus (Channel 0) is disabled and if the
DS3/E3 Framer block is enabled then this pin will function as either a
Transmit Framing Reference input pin or as a Transmit Framing Ref-
erence output pin.
If the Frame Generator (within the DS3/E3 Framer block) is con-
figured to operate in the Loop-Timing or in the Local-Timing/
Asynchronous Framing Mode:
This pin will function as a Framing Reference Output pin. The Frame
Generator block (associated with Channel 4) will pulse this output pin
"High" for one DS3/E3 bit-period, one period prior to the first bit of a
given DS3 or E3 frame being applied to the DS3/E3/
STS1_DATA_IN_4 input pin.
If the Frame Generator (within the DS3/E3 Framer block) is con-
figured to operate in the Local-Timing/TxDS3FP Mode:
This pin will function as a Framing Reference Input pin. In this mode,
the user is expected to pulse this input pin "High" for one DS3 or E3
bit-period, coincident with the first bit of a given DS3 or E3 frame,
being placed on the DS3/E3/STS1_DATA_IN_4 input pin. The Frame
Generator block (associated with Channel 4) will synchronize its gen-
eration of DS3 or E3 frames to these framing pulses applied to this
input pin.
NOTE: This pin is inactive if the Frame Generator block, associated
with Channel 4 is by-passed.
STS-3/STM-1 TELECOM BUS INTERFACE - TRANSMIT DIRECTION
PIN #SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
| XTR114U/2K5 | IC 4-20MA I-TRANSMITTER 14-SOIC |
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| 3342-56 | IC PLL INTEGER-N 3GHZ 20QFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT94L55 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT94L55IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT95L34 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L34IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L51 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-48 ATM UNI/POS/MAPPER IC |
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