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參數(shù)資料
| 型號： | XRT94L43IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 266/328頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER SONET/SDH OC12 516BGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 2.5V, 3.3V |
| 封裝/外殼： | 516-BBGA |
| 供應(yīng)商設(shè)備封裝： | 516-PBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L43
36
REV. 1.0.2
SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
B24
STS3TxA_C1J1_0
ING_LCV_IN_8
ING_RxNEG_IN_8
TxSTS1PL_8
I/O
TTL/
CMOS
Transmit STS-3/STM-1 Telecom Bus Interface C1/J1 Byte Phase
Indicator Input Signal (Channel 0); DS3/E3 Framer Block LCV/
RxNEG Input Pin - Channel 8:
The function of this pin depends upon whether or not theSTS-3/STM-
1 Telecom Bus Interface for Trlrcom Bus Channel 0 has been
enabled.
If STS-3/STM-1 Telecom Bus (Telecom Bus Channel 0) has been
enabled - Transmit STS-3/STM-1 Telecom Bus Interface C1/J1
Byte Phase Indicator Input Signal (Channel 0):
This input pin should be pulsed "high" during both of the following
conditions.
1. Whenever the C1 byte is being input to the STS-3/STM-1
Transmit Telecom Bus (TXA_D_0[7:0]) input pins.
2. Whenever the J1 byte is being input to the STS-3/STM-1
Transmit Telecom Bus (TXA_D_0[7:0]) input pins.
If STS-3/STM-1 Telecom Bus (Channel 0) is disabled - DS3/E3
Framer Block LCV/NEG Input - Channel 8:
If the STS-3/STM-1 Telecom Bus (Channel 0) is disabled and if the
DS3/E3 Framer block (associated with Channel 8) is enabled then
this pin will function as either an LCV or an RxNEG input pin.
If Channel 8 is configured to operate in the Single- Rail Mode,
and if the Primary Frame Synchronizer block is configured to
operate in the Ingress Path - ING_LCV_IN_8 Input pin:
If the Primary Frame Synchronizer Block (associated with Channel 8)
is configured to operate in the Ingress Path, and if Channel 8 is con-
figured to operate in the Single-Rail Mode, then this input pin will
function as the "LCV" (Line Code Violation) input pin. In this case,
the user should connect this particular input pin to the "LCV" output
pin of the corresponding DS3/E3/STS-1 LIU Channel.
If Channel 8 is configured to operate in the Dual-Rail Mode, and
if the Primary Frame Synchronizer block is configured to oper-
ate in the Ingress Path - ING_RxNEG_IN_8:
If the Primary Frame Synchronizer block (associated with Channel 8)
is configured to operate in the Ingress Path, and if Channel 8 is con-
figured to operate in the Dual-Rail Mode, then this input pin will func-
tion as the "RxNEG" (Negative Polarity Data) input pin. In this case,
the user should connect this particular input to the "RxNEG" output
pin of the corresponding DS3/E3/STS-1 LIU Channel.
NOTE: This pin is inactive if the Primary Frame Synchronizer block
(associated with Channel 8) is NOT configured to operate in
the Ingress Path.
STS-3/STM-1 TELECOM BUS INTERFACE - TRANSMIT DIRECTION
PIN #SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT94L55 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT94L55IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT95L34 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L34IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L51 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-48 ATM UNI/POS/MAPPER IC |
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