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參數(shù)資料
| 型號： | XRT94L43IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 60/328頁 |
| 文件大小： | 0K |
| 描述： | IC MAPPER SONET/SDH OC12 516BGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 2.5V, 3.3V |
| 封裝/外殼： | 516-BBGA |
| 供應(yīng)商設(shè)備封裝： | 516-PBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L43
146
REV. 1.0.2
SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
U25
PBLAST_L
I
TTL
Last Burst Transfer Indicator input Pin:
If the Microprocessor Interface is operating in the Intel-I960 Mode, then this
input pin is used to indicate (to the Microprocessor Interface block) that the
current data transfer is the last data transfer within the current burst opera-
tion.
The Microprocessor should assert this input pin (by toggling it "Low") in
order to denote that the current READ or WRITE operation (within a
BURST operation) is the last operation of this BURST operation.
AC26
PINT_L
O
CMOS
Interrupt Request Output:
This open-drain, active-low output signal will be asserted when the Mapper/
Framer device is requesting interrupt service from the Microprocessor. This
output pin should typically be connected to the Interrupt Request input of
the Microprocessor.
L24
RESET_L
I
TTL
Reset Input:
When this active-Low signal is asserted, the XRT94L43 will be asynchro-
nously reset. When this occurs, all outputs will be tri-stated and all on-chip
registers will be reset to their default values.
SONET/SDH SERIAL LINE INTERFACE PINS
PIN #
SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
M5
RXL_CLKL_P
I
LVPECL
Receive STS-12/STM-4 Clock - Positive Polarity PECL Input:
This input pin, along with RXL_CLKL_N functions as the Recov-
ered Clock Input, from a System back-plane or an Optical Trans-
ceiver. The Receive STS-12/STM-4 Interface Block will sample the
data, applied at the RXLDATA_P/RXLDATA_N input pins, upon the
rising edge of this signal.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_CLKL_N functions as the
Primary Receive Clock Input port.
L5
RXL_CLKL_N
I
LVPECL
Receive STS-12/STM-4 Clock - Negative Polarity PECL Input:
This input pin, along with RXL_CLKL_P functions as the Recov-
ered Clock Input, from a System back-plane or an Optical Trans-
ceiver. The Receiver STS-12/STM-4 Interface Block will sample
the data applied at the RXLDATA_P/RXLDATA_N input pins, upon
the falling edge of this signal.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_CLKL_P functions as the
Primary Receive Clock Input Port.
MICROPROCESSOR INTERFACE
PIN #SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT94L55IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT95L34 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L34IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L51 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-48 ATM UNI/POS/MAPPER IC |
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