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參數(shù)資料
| 型號： | XRT94L43IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 61/328頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MAPPER SONET/SDH OC12 516BGA |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 應(yīng)用： | 網(wǎng)絡(luò)切換 |
| 接口： | 總線 |
| 電源電壓： | 2.5V, 3.3V |
| 封裝/外殼： | 516-BBGA |
| 供應(yīng)商設(shè)備封裝： | 516-PBGA（35x35） |
| 包裝： | 托盤 |
| 安裝類型： | 表面貼裝 |
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XRT94L43
147
SONET/SDH OC-12 TO 12XDS3/E3 MAPPER
REV. 1.0.2
K2
RXL_CLKL_R_P
I
LVPECL
Receive STS-12/STM-4 Clock - Positive Polarity PECL Input -
Redundant Port:
This input pin, along with RXL_CLKL_R_N functions as the Recov-
ered Clock Input, from a System back-plane or an Optical Trans-
ceiver. The Receive STS-12/STM-4 Interface Block will sample the
data, applied at the RXLDATA_P/RXLDATA_N input pins, upon the
rising edge of this signal.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_CLKL_R_N functions as the
Redundant Receive Clock Input Port.
K1
RXL_CLKL_R_N
I
LVPECL
Receive STS-12/STM-4 Clock - Negative Polarity PECL Input -
Redundant Port:
This input pin, along with RXL_CLKL_P functions as the Recov-
ered Clock Input, from a System back-plane or an Optical Trans-
ceiver. The Receiver STS-12/STM-4 Interface Block will sample
the data applied at the RXLDATA_P/RXLDATA_N input pins, upon
the falling edge of this signal.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_CLKL_R_ P functions as the
Redundant Receive Clock Input Port.
K4
RXL_DATA_P
I
LVPECL
Receive STS-12/STM-4 Data - Positive Polarity PECL Input:
This input pin, along with RXL_DATA_N functions as the Recov-
ered Data Input, from a System back-plane or an Optical Trans-
ceiver. The Receive STS-12/STM-4 Interface block will sample the
data applied to these input pins, upon the rising edge of the
RXL_CLKL_P (and the falling edge of the RXL_CLKL_N) signals.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_DATA_N functions as the
Primary Receive Data Input Port.
L4
RXL_DATA_N
I
LVPECL
Receive STS-12/STM-4 Data - Negative Polarity PECL Input:
This input pin, along with RXL_DATA_P functions as the Recov-
ered Data Input, from a System back-plane or an Optical Trans-
ceiver. The Receive STS-12/STM-4 Interface block will sample the
data applied to these input pins, upon the rising edge of the
RXL_CLKL_P (and the falling edge of the RXL_CLKL_N) signals.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_DATA_P functions as the
Primary Receive Data Input Port.
K3
RXL_DATA_R_P
I
LVPECL
Receive STS-12/STM-4 Data - Positive Polarity PECL Input -
Redundant Port:
This input pin, along with RXL_DATA_R_N functions as the Recov-
ered Data Input, from a System back-plane or an Optical Trans-
ceiver. The Receive STS-12/STM-4 Interface block will sample the
data applied to these input pins, upon the rising edge of the
RXL_CLKL_R_P (and the falling edge of the RXL_CLKL_R_N) sig-
nals.
NOTE: For APS (Automatic Protection Switching) purposes, this
input pin, along with RXL_DATA_R_N functions as the
Redundant Receive Data Input Port.
SONET/SDH SERIAL LINE INTERFACE PINS
PIN #SIGNAL NAME
I/O
SIGNAL
TYPE
DESCRIPTION
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XS1-G02B-FB144-I4 | IC MCU 32BIT 16KB OTP 144FBGA |
| XTR114U/2K5 | IC 4-20MA I-TRANSMITTER 14-SOIC |
| ZXHF5000JB24TC | IC SWITCH QUAD 2X1 24QFN |
| 3341-56 | IC PLL INTEGER-N 3GHZ 20QFN |
| 3342-56 | IC PLL INTEGER-N 3GHZ 20QFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT94L55 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT94L55IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET/SDH OC-48/STM-16, 4XOC-12/STM-4, 16XOC-3/STM-1 FRAMER/CONCENTRATOR WITH INTEGRATED CDR’S |
| XRT95L34 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L34IV | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-12/STM-4, QUAD OC-3/STM-1 POS/ATM FRAMER WITH INTEGRATED CDR’S |
| XRT95L51 | 制造商:EXAR 制造商全稱:EXAR 功能描述:OC-48 ATM UNI/POS/MAPPER IC |
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